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參數(shù)資料
| 型號(hào)： | CY3930V484-125BGI |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | CPLDs at FPGA Densities |
| 中文描述： | CPLD器件在FPGA的密度 |
| 文件頁數(shù)： | 18/86頁 |
| 文件大小： | 1212K |
| 代理商： | CY3930V484-125BGI |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 25 of 86
Switching Waveforms (continued)
Registered Output with Synchronous Clocking (Macrocell)
tMCS
INPUT
SYNCHRONOUS
tMCCO
REGISTERED
OUTPUT
tMCH
CLOCK
Registered Input in I/O Cell
tIOS
DATA
INPUT
INPUT REGISTER
CLOCK
tIOCO
REGISTERED
OUTPUT
tIOH
Clock to Clock
INPUT REGISTER
CLOCK
MACROCELL
REGISTER CLOCK
tSCS
tICS
PT Clock to PT Clock
DATA
PT CLOCK
tSCS2PT
tMCSPT
INPUT
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY3950V484-125BGI | CPLDs at FPGA Densities |
| CY3930V484-125MBC | CPLDs at FPGA Densities |
| CY3950V484-125MBC | CPLDs at FPGA Densities |
| CY3930V484-125MBI | CPLDs at FPGA Densities |
| CY3950V484-125MBI | CPLDs at FPGA Densities |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY3930V484-125MBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3930V484-125MBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3930Z208-125BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3930Z208-125BBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3930Z208-125BGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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