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參數(shù)資料
| 型號： | CY3950V484-125MBC |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | CPLDs at FPGA Densities |
| 中文描述： | CPLD器件在FPGA的密度 |
| 文件頁數(shù)： | 19/86頁 |
| 文件大?。?/td> | 1212K |
| 代理商： | CY3950V484-125MBC |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 26 of 86
Switching Waveforms (continued)
Asynchronous Reset/Preset
INPUT
tPRO
REGISTERED
OUTPUT
CLOCK
tPRR
tPRW
RESET/PRESET
Output Enable/Disable
GLOBAL CONTROL
tER
OUTPUTS
tEA
INPUT
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY3930V484-125MBI | CPLDs at FPGA Densities |
| CY3950V484-125MBI | CPLDs at FPGA Densities |
| CY37128VP160-200AXC | 5V, 3.3V, ISRTM High-Performance CPLDs |
| CY37256VP160-200AXC | 5V, 3.3V, ISRTM High-Performance CPLDs |
| CY37384VP160-200AXC | 5V, 3.3V, ISRTM High-Performance CPLDs |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY3950V484-125MBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3950Z208-125BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3950Z208-125BBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3950Z208-125BGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3950Z208-125BGI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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