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參數(shù)資料
| 型號(hào)： | CY7C1483V33-100BZXC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | DRAM |
| 英文描述： | 72-Mbit (2M x 36/4M x 18/1M x 72) Flow-Through SRAM |
| 中文描述： | 4M X 18 CACHE SRAM, 8.5 ns, PBGA165 |
| 封裝： | 15 X 17 MM, 1.40 MM HEIGHT, LEAD FREE, FBGA-165 |
| 文件頁(yè)數(shù)： | 25/30頁(yè) |
| 文件大?。?/td> | 998K |
| 代理商： | CY7C1483V33-100BZXC |
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CY7C1481V33
CY7C1483V33
CY7C1487V33
Document #: 38-05284 Rev. *H
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Figure 4. ZZ Mode Timing
[25, 26]
Timing Diagrams
(continued)
tZZ
I
SUPPLY
CLK
ZZ
tZZREC
ALL INPUTS
(except ZZ)
DON’T CARE
IDDZZ
tZZI
tRZZI
Outputs (Q)
High-Z
DESELECT or READ Only
Notes
25.Device must be deselected when entering ZZ mode. See
“Truth Table” on page 10
for all possible signal conditions to deselect the device.
26.DQs are in High-Z when exiting ZZ sleep mode.
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相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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