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參數(shù)資料
| 型號(hào)： | CY7C43682 |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | 16K x36 x2 Bidirectional Synchronous FIFO(16K x36 x2 雙向同步先進(jìn)先出) |
| 中文描述： | 16K的x36 x2雙向同步FIFO（16K的x36 x2雙向同步先進(jìn)先出） |
| 文件頁數(shù)： | 14/31頁 |
| 文件大?。?/td> | 463K |
| 代理商： | CY7C43682 |
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CY7C43622
CY7C43632/CY7C43642
CY7C43662/CY7C43682
14
PRELIMINARY
Note:
19. t
is the minimum time between a rising CLKA edge and a rising CLKB edge for EFB to transition HIGH in the next CLKB cycle. If the time between
the rising CLKA edge and rising CLKB edge is less than t
SKEW1
, then the transition of EFB HIGH may occur one CLKB cycle later than shown.
Switching Waveforms
(continued)
t
CLKH
t
CLKL
t
ENS
t
ENH
t
ENS
t
ENH
t
A
t
DS
W1
LOW
t
DH
HIGH
HIGH
FIFO1 Empty
LOW
HIGH
LOW
W1
t
ENS
t
ENH
t
REF
t
REF
t
CLKH
t
CLKL
t
CLK
t
CLK
t
SKEW1[19]
CLKA
CSA
W/RA
MBA
ENA
FFA/IRA
A
0
–
35
CLKB
EFB/ORB
CSB
W/RB
MBB
ENB
B
0
–
35
EFB Flag Timing and First Data Read Fall Through when FIFO1 is
Empty (CY Standard Mode)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY7C43633 | 512 x36 Unidirectional Synchronous FIFO w/ Bus Matching(512 x36 單向同步先進(jìn)先出帶總線匹配) |
| CY7C43623 | 256 x36 Unidirectional Synchronous FIFO w/ Bus Matching(256 x36 單向同步先進(jìn)先出帶總線匹配) |
| CY7C43643 | 1K x36 Unidirectional Synchronous FIFO w/ Bus Matching(1K x36 單向同步先進(jìn)先出帶總線匹配) |
| CY7C43663 | 4K x36 Unidirectional Synchronous FIFO w/ Bus Matching(4K x36 單向同步先進(jìn)先出帶總線匹配) |
| CY7C43683 | 16K x36 Unidirectional Synchronous FIFO w/ Bus Matching(16K x36 單向同步先進(jìn)先出帶總線匹配) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| CY7C43683-10AI | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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| CY7C43684-10AC | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| CY7C43684AV-10AC | 制造商:Cypress Semiconductor 功能描述:FIFO Mem Sync Dual Depth/Width Bi-Dir 16K x 36 x 2 128-Pin TQFP 制造商:Rochester Electronics LLC 功能描述:3.3V BIDIR SYNC FIFO W/ BUS MATCHING 16KX32X2 - Bulk |
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