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參數(shù)資料
| 型號： | CY8C22213-24SIT |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | PSoC Mixed Signal Array |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PDSO20 |
| 封裝： | 0.300 INCH, MO-119, SOIC-20 |
| 文件頁數(shù)： | 239/304頁 |
| 文件大?。?/td> | 2956K |
| 代理商： | CY8C22213-24SIT |
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December 22, 2003
Document No. 38-12009 Rev. *D
239
22.
Switched Capacitor Block
This chapter presents the Analog Switched Capacitor Block and its associated registers. The analog Switched Capacitor (SC)
blocks are built around a low offset, low noise operational amplifier.
The Analog Switched Capacitor blocks are built around a
rail-to-rail, input and output, low offset and low noise opamp.
There are several analog muxes controlled by register-bit
settings in the control registers that determine the signal
topology inside the block. There are four user selectable
capacitor arrays inside this block connected to the opamp.
The block also contains a low power comparator, connected
to the same inputs and outputs as the main amplifier. This
comparator is useful for providing a digital compare output in
low power sleep modes, when the main amplifier is powered
off.
The four arrays are labeled A Cap Array, B Cap Array, C
Cap Array, and F Cap Array, and have user selectable unit
values: one array is in the feedback path of the opamp and
three arrays are in the input path of the opamp. Analog
muxes, controlled by bit settings in control registers, set the
capacitor topology inside the block. A group of muxes are
used for the signal processing switch synchronously to
clocks PHI1 and PHI2, with behavior that is modified by con-
trol register settings. There is also an analog comparator
that converts the opamp output (relative the local analog
ground) into a digital signal.
There are two types of Analog Switched Capacitor blocks
called Type C and Type D. Their primary differences relate
to connections of the C Cap Array and the block’s position in
a two pole filter section. The Type D block also has greater
flexibility in switching the B Cap Array.
There are three discrete outputs from this block. These out-
puts connect to the following buses:
1.
The analog output bus (ABUS), which is an analog bus
resource shared by all of the analog blocks in the col-
umn. This signal may also be routed externally through
the output buffer.
2.
The comparator bus (CBUS), which is a digital bus
resource shared by all of the analog blocks in the col-
umn.
3.
The local output bus (OUT), which is an analog node
which is routed to neighboring block inputs.
Table 22-1. Analog Switched Capacitor Block Registers
Address
Analog Switch Cap Type C PSoC Block Control Registers
x,xxh
ASCxxCR0
x,xxh
ASCxxCR1
x,xxh
ASCxxCR2
AnalogBus
x,xxh
ASCxxCR3
Analog Switch Cap Type D PSoC Block Control Registers
x,xxh
ASDxxCR0
x,xxh
ASDxxCR1
x,xxh
ASDxxCR2
AnalogBus
x,xxh
ASDxxCR3
LEGEND
x: An “x” before the comma in the address field indicates that the register exists in both register banks.
xx: An “x” after the comma in the address field indicates that there are multiple instances of the register. For an expanded address listing of these registers,
refer to the
“Analog Register Summary” on page 221
.
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Access
FCap
ClockPhase
ACMux[2:0]
CompBus
ASign
ACap[4:0]
BCap[4:0]
CCap[4:0]
RW : 00
RW : 00
RW : 00
RW : 00
AutoZero
FSW1
ARefMux[1:0]
FSW0
BMuxSC[1:0]
PWR[1:0]
FCap
ClockPhase
AMux[2:0]
CompBus
ASign
ACap[4:0]
BCap[4:0]
CCap[4:0]
BMuxSD
RW : 00
RW : 00
RW : 00
RW : 00
AutoZero
FSW1
ARefMux[1:0]
FSW0
BSW
PWR[1:0]
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PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| CY8C22345-12PVXET | 功能描述:可編程片上系統(tǒng) - PSoC M8C 8bit Flash 16KB RoHS:否 制造商:Cypress Semiconductor 核心:8051 處理器系列:CY8C36 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:67 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:4 KB 片上 ADC:Yes 工作電源電壓:0.5 V to 5.5 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:QFN-68 安裝風(fēng)格:SMD/SMT |
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