參數資料
型號： CYDM064B16
廠商： Cypress Semiconductor Corp.
英文描述： 1.8V 4K/8K/16K x 16 MoBL㈢ Dual-Port Static RAM
中文描述： 1.8 4K/8K/16K㈢× 16的MoBL雙端口靜態(tài)存儲器
文件頁數： 21/25頁
文件大小： 583K
代理商： CYDM064B16
CYDM256B16
CYDM128B16
CYDM064B16
Document #: 001-00217 Rev. *E
Page 21 of 25
Busy Timing Diagram No.1 (CE Arbitration)
Busy Timing Diagram No.2 (Address Arbitration)
[50]
Note:
50.If t
PS
is violated, the busy signal will be asserted on one side or the other, but there is no guarantee to which side BUSY will be asserted.
Switching Waveforms
(continued)
ADDRESS MATCH
t
PS
t
BLC
t
BHC
ADDRESS MATCH
t
PS
t
BLC
t
BHC
CE
R
Valid First
ADDRESS
L,R
BUSY
R
CE
L
CE
R
BUSY
L
CE
R
CE
L
ADDRESS
L,R
CE
L
Valid First
[50]
ADDRESS MATCH
t
PS
ADDRESS
L
BUSY
R
ADDRESS MISMATCH
t
RC
or t
WC
t
BLA
t
BHA
ADDRESS
R
ADDRESS MATCH
ADDRESS MISMATCH
t
PS
ADDRESS
L
BUSY
L
t
RC
or t
WC
t
BLA
t
BHA
ADDRESS
R
Right Address Valid First
Left Address Valid First
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相關PDF資料
PDF描述
CYDM128B16 1.8V 4K/8K/16K x 16 MoBL㈢ Dual-Port Static RAM
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