- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄379099 > CYM1841C (Cypress Semiconductor Corp.) 256K x 32 Static RAM Module(256K x 32 靜態(tài)RAM模塊) PDF資料下載
參數(shù)資料
| 型號： | CYM1841C |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | 256K x 32 Static RAM Module(256K x 32 靜態(tài)RAM模塊) |
| 中文描述： | 256K × 32靜態(tài)RAM模塊（256K × 32靜態(tài)內(nèi)存模塊） |
| 文件頁數(shù)： | 5/11頁 |
| 文件大?。?/td> | 274K |
| 代理商： | CYM1841C |
CYM1841A
CYM1841C
5
Switching Characteristics
Over the Operating Range (continued)
[4]
1841A-35
1841C-35
Min.
1841A-45
1841C-45
Min.
Parameter
READ CYCLE
t
RC
t
AA
t
OHA
t
ACS
t
DOE
t
LZOE
t
HZOE
t
LZCS
t
HZCS
t
PD
WRITE CYCLE
[7]
t
WC
t
SCS
t
AW
t
HA
t
SA
t
PWE
t
SD
t
HD
t
LZWE
t
HZWE
Description
Max.
Max.
Unit
Read Cycle Time
35
45
ns
Address to Data Valid
Data Hold from Address Change
35
45
ns
ns
3
3
CS LOW to Data Valid
35
45
ns
OE LOW to Data Valid
OE LOW to Low Z
25
30
ns
ns
0
0
OE LOW to High Z
CS LOW to Low Z
[5]
CS HIGH to High Z
[5, 6]
15
15
ns
10
10
ns
ns
20
20
CS HIGH to Power-Down
35
45
ns
Write Cycle Time
35
45
ns
CS LOW to Write End
30
40
ns
Address Set-Up to Write End
Address Hold from Write End
30
2
40
2
ns
ns
Address Set-Up to Write Start
2
2
ns
WE Pulse Width
Data Set-Up to Write End
30
20
35
25
ns
ns
Data Hold from Write End
2
2
ns
WE HIGH to Low Z
WE LOW to High Z
[6]
0
0
0
0
ns
ns
15
15
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CYM1841V33 | 256K x 32 3.3V Static RAM Module(256K x 32 位3.3V 靜態(tài)RAM模塊) |
| CYM1846V33 | 512K x 32 3.3V Static RAM Module(512K x 32 3.3V 靜態(tài)RAM模塊) |
| CYM1846 | 512K x 32 Static RAM Module(512K x 32 位靜態(tài)模塊) |
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| CYM1851PZ-15C | 1,024K x 32 Static RAM Module |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| CYM1841CP7-20C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x32 SRAM Module |
| CYM1841CP7-25C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x32 SRAM Module |
| CYM1841CP7-35C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x32 SRAM Module |
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