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參數資料
| 型號： | DPS256X32AV3-45M |
| 英文描述： | x32 SRAM Module |
| 中文描述： | X32號的SRAM模塊 |
| 文件頁數： | 6/10頁 |
| 文件大?。?/td> | 839K |
| 代理商： | DPS256X32AV3-45M |
Dense-Pac Microsystems, Inc.
DPS256X16Cn3/DPS256X16Bn3
READ CYCLE
NOTE: SEL, tCO2, tLZ2 and tHZ2 apply to DPS256X16Cn3 version only.
ADDRESS
CE
SEL
OE
DATA I/O
WAVEFORM KEY
Data Valid
Transition from
Data Undefined
HIGH to LOW
LOW to HIGH
or Don’t Care
AC OPERATING CONDITIONS AND CHARACTERISTICS - READ CYCLE:
Over operating ranges
No. Symbol
Parameter
20ns*
25ns
30ns
35ns
45ns
Unit
Min. Max. Min. Max. Min. Max. Min. Max. Min. Max.
1
tRC
Read Cycle Time
20
25
30
35
45
ns
2
tAA
Address Access Time
20
25
30
35
45
ns
3
tCO1
CE to Output Valid
20
25
30
35
45
ns
4
tCO2
SEL to Output Valid
20
25
30
35
45
ns
5
tOE
Output Enable to Output Valid
8
10
15
20
25
ns
6
tLZ1
CE to Output in LOW-Z 4, 5
3
ns
7
tLZ2
SEL to Output in LOW-Z 4, 5
3
ns
8
tOLZ
Output Enable to Output in LOW-Z 4, 5
0
ns
9
tHZ1
CE to Output in HIGH-Z 4, 5
10
12
15
20
25
ns
10
tHZ2
SEL to Output in HIGH-Z 4, 5
10
12
15
20
25
ns
11
tOHZ
Output Enable to Output in HIGH-Z 4, 5
8
10
15
20
25
ns
12
tOH
Output Hold from Address Change
3
ns
* Available in Commercial Only.
NOTE: tCO2, tLZ2 and tHZ2 apply to DPS256X16Cn3 version only.
30A097-34
REV. G
5
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相關PDF資料 |
PDF描述 |
|---|---|
| DPS256X32AV3-55B | x32 SRAM Module |
| DPS256X32AV3-55C | x32 SRAM Module |
| DPS256X32AV3-55I | x32 SRAM Module |
| DPS256X32AV3-55M | x32 SRAM Module |
| DPS256X32AV3-70B | x32 SRAM Module |
相關代理商/技術參數 |
參數描述 |
|---|---|
| DPS256X32AV3-55B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x32 SRAM Module |
| DPS256X32AV3-55C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x32 SRAM Module |
| DPS256X32AV3-55I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x32 SRAM Module |
| DPS256X32AV3-55M | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x32 SRAM Module |
| DPS256X32AV3-70B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x32 SRAM Module |
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