Table 4-12 SSI Slave Mode
參數(shù)資料
型號： DSP56852VFE
廠商： Freescale Semiconductor
文件頁數(shù)： 29/48頁
文件大小： 0K
描述： IC DSP 16BIT 120MHZ 81-MAPBGA
標(biāo)準(zhǔn)包裝： 348
系列： 568xx
核心處理器： 56800E
芯體尺寸： 16-位
速度： 120MHz
連通性： EBI/EMI，SCI，SPI，SSI
外圍設(shè)備： POR，WDT
輸入/輸出數(shù)： 11
程序存儲器容量： 12KB（6K x 16）
程序存儲器類型： SRAM
RAM 容量： 4K x 16
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 3.3 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 81-LFBGA
包裝： 托盤
Synchronous Serial Interface (SSI) Timing
56852 Technical Data, Rev. 8
Freescale Semiconductor
35
Table 4-12 SSI Slave Mode1 Switching Characteristics
Operating Conditions: VSS = VSSIO = VSSA = 0V, VDD = 1.62-1.98V, VDDIO = VDDA = 3.0–3.6V, TA = –40° to +120°C, CL ≤ 50pF, fop = 120MHz
Parameter
Symbol
Min
Typ
Max
Units
STCK frequency
fs
152
MHz
STCK period3
tSCKW
66.7
ns
STCK high time
tSCKH
33.44
ns
STCK low time
tSCKL
33.44
ns
Output clock rise/fall time
4
ns
Delay from STCK high to STFS (bl) high - Slave5
tTFSBHS
-1
29
ns
Delay from STCK high to STFS (wl) high - Slave5
tTFSWHS
-1
29
ns
Delay from SRCK high to SRFS (bl) high - Slave5
tRFSBHS
-1
29
ns
Delay from SRCK high to SRFS (wl) high - Slave5
tRFSWHS
-1
29
ns
Delay from STCK high to STFS (bl) low - Slave5
tTFSBLS
-29
29
ns
Delay from STCK high to STFS (wl) low - Slave5
tTFSWLS
-29
29
ns
Delay from SRCK high to SRFS (bl) low - Slave5
tRFSBLS
-29
29
ns
Delay from SRCK high to SRFS (wl) low - Slave5
tRFSWLS
-29
29
ns
STCK high to STXD enable from high impedance - Slave
tTXES
—
15
ns
STCK high to STXD valid - Slave
tTXVS
4
15
ns
STFS high to STXD enable from high impedance (first bit) -
Slave
tFTXES
4
15
ns
STFS high to STXD valid (first bit) - Slave
tFTXVS
4
15
ns
STCK high to STXD not valid - Slave
tTXNVS
4
15
ns
STCK high to STXD high impedance - Slave
tTXHIS
4
15
ns
SRXD Setup time before SRCK low - Slave
tSS
4
—
ns
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PDF描述
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