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參數(shù)資料
| 型號(hào)： | EPM9320 |
| 廠商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family(MAX9000可編程邏輯系列器件) |
| 中文描述： | 可編程邏輯器件系列（MAX9000可編程邏輯系列器件） |
| 文件頁數(shù)： | 31/41頁 |
| 文件大小： | 604K |
| 代理商： | EPM9320 |
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Altera Corporation
31
MAX 9000 Programmable Logic Device Family Data Sheet
Table 20. IOC Delays
Symbol
Parameter
Conditions
Speed Grade
Unit
-10
-15
-20
Min
Max
Min
Max
Min
Max
t
IODR
t
IODC
t
IOC
t
IORD
I/O row output data delay
0.2
0.2
1.5
ns
I/O column output data delay
0.4
0.2
1.5
ns
I/O control delay
(6)
0.5
1.0
2.0
ns
I/O register clock-to-output
delay
0.6
1.0
1.5
ns
t
IOCOMB
t
IOSU
I/O combinatorial delay
0.2
1.0
1.5
ns
I/O register setup time before
clock
2.0
4.0
5.0
ns
t
IOH
I/O register hold time after
clock
1.0
1.0
1.0
ns
t
IOCLR
t
IOFD
t
INREG
I/O register clear delay
1.5
3.0
3.0
ns
I/O register feedback delay
0.0
0.0
0.5
ns
I/O input pad and buffer to I/O
register delay
3.5
4.5
5.5
ns
t
INCOMB
I/O input pad and buffer to row
and column delay
1.5
2.0
2.5
ns
t
OD1
Output buffer and pad delay,
Slow slew rate = off,
V
CCIO
= 5.0 V
Output buffer and pad delay,
Slow slew rate = off,
V
CCIO
= 3.3 V
Output buffer and pad delay,
Slow slew rate = on,
V
CCIO
= 5.0 V or 3.3 V
Output buffer disable delay
C1 = 35 pF
1.8
2.5
2.5
ns
t
OD2
C1 = 35 pF
2.3
3.5
3.5
ns
t
OD3
C1 = 35 pF
8.3
10.0
10.5
ns
t
XZ
t
ZX1
C1 = 5 pF
2.5
2.5
2.5
ns
Output buffer enable delay,
Slow slew rate = off,
V
CCIO
= 5.0 V
Output buffer enable delay,
Slow slew rate = off,
V
CCIO
= 3.3 V
Output buffer enable delay,
Slow slew rate = on,
V
CCIO
= 3.3 V or 5.0 V
C1 = 35 pF
2.5
2.5
2.5
ns
t
ZX2
C1 = 35 pF
3.0
3.5
3.5
ns
t
ZX3
C1 = 35 pF
9.0
10.0
10.5
ns
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PDF描述 |
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