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參數(shù)資料
| 型號： | HS1-80C86RH-Q |
| 廠商： | INTERSIL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Radiation Hardened 16-Bit CMOS Microprocessor |
| 中文描述： | 16-BIT, 5 MHz, MICROPROCESSOR, CDIP40 |
| 封裝： | SIDE BRAZED, METAL SEALED, CERAMIC, DIP-40 |
| 文件頁數(shù)： | 21/37頁 |
| 文件大小： | 239K |
| 代理商： | HS1-80C86RH-Q |
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876
Spec Number
518055
HS-80C86RH
FIGURE 8. BUS TIMING - MINIMUM MODE SYSTEM
NOTES:
1. All signals switch between VOH and VOL unless otherwise specified.
2. RDY is sampled near the end of T2, T3, TW to determine if TW machines states are to be inserted.
3. Two INTA cycles run back-to-back. The HS-80C86RH local ADDR/DATA bus is inactive during both INTA cycles. Control signals are
shown for the second INTA cycle.
4. Signals at HS-82C85RH are shown for reference only.
5. All timing measurements are made at 1.5V unless otherwise noted.
Waveforms
(Continued)
TCLCL
TW
T1
T2
T3
T4
TCHCTV
TCHCL
TCLCH
TCHCTV
TCLAV
TAVLL
TCLDV
TCLAX
TCLAV
TLHLL
TLLAX
TCHLL
TCLLH
TR1VCL
TCHRYX
VIH
VIL
TRYLCL
TCLRIX
TRYHCH
TCLAZ
TDVCL
TCLDX1
TAZRL
TCLRH
TRHAV
TRLRH
TCHCTV
TCVCTX
TCVCTV
TCLRL
TCHCTV
CLK (HS-82C85RH OUTPUT)
M/IO
BHE/S7, A19/S6-A16/S3
ALE
RDY (HS-82C85RH INPUT)
SEE NOTE 4
READY (HS-80C86RH INPUT)
READ CYCLE
(NOTE 1)
(WR, INTA = VOH)
AD15-AD0
RD
DT/R
DEN
TCH1CH2
TCL2CL1
AD15-AD0
DATA IN
S7-S3
BHE, A19-A16
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HS9-80C86RH-Q | Radiation Hardened 16-Bit CMOS Microprocessor |
| HS9-80C86RH | Radiation Hardened 16-Bit CMOS Microprocessor |
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| HS-81C55RH | Radiation Hardened 256 x 8 CMOS RAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| HS18140R | 制造商:Microsemi Corporation 功能描述:DIODE SCHOTTKY 40V 180A HALF PAK |
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