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參數(shù)資料
| 型號： | IBM3206K0424 |
| 廠商： | IBM Microeletronics |
| 英文描述： | IBM Processor for Network Resources(異步轉(zhuǎn)換模式（ATM）32位微處理器（用于網(wǎng)絡資源管理）) |
| 中文描述： | IBM的處理器（異步轉(zhuǎn)換模式（ATM）的32位微處理器的網(wǎng)絡資源（用于網(wǎng)絡資源管理）） |
| 文件頁數(shù)： | 400/676頁 |
| 文件大小： | 9810K |
| 代理商： | IBM3206K0424 |
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IBM3206K0424
IBM Processor for Network Resources
Preliminary
Receive Queues (RXQUE)
Page 400 of 676
pnr25.chapt05.01
August 14, 2000
13.19: RXQUE Control Register
Used to set RXQUE modes. See
Note on Set/Clear Type Registers on page 93
for more details on address-
ing. This register contains the mode bits that specify how RXQUE is to operate.
Length
32 bits
Type
Clear/Set
Address
XXXX 1C00 and C04
Power On Value
X
’
00000300
’
Restrictions
None
R
Reserved
A
A
E
E
A
E
M
I
T
R
B
D
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9
8
7
6
5
4
3
2
1
0
Bit(s)
Name
Description
31
Reset FIFO
When this bit is set, the internal FIFO is flushed, and this bit is reset. The result is this
bit will always be read as a
’
0
’
. This bit can only be set in diagnostic mode.
30-12
Reserved
Reserved.
11
Assume 64-bit PCI
10
Assume 32-bit PCI
9
Enable swap words on PCI
This bit is automatically set at power-on.
8
Enable swap bytes on PCI
This bit is automatically set at power-on.
7
Always route error events
When this bit is set, all error events are routed to the error queue even if rx bad frames
(bit2) is turned on. When cleared, error events are only routed to the error queue if rx
bad frames is turned off. This bit allows the user to keep bad frames in time sequence
with good frames or to route them to the error queue. The clear state of this bit is code
compatible with previous versions of the processor.
6
Enable chip overflow events
When set, the chip level counter overflow events are surfaced.
5
Memory select
When this bit is set, RXQUE will use Packet Memory instead of Control Memory to
store the event queues.
4
Inhibit enqueues
When this bit is set, the enq state machine will not accept any new enq requests. This
should be used in extreme cases as it holds off all enqueues indefinitely.
3
Timestamp mode
When this bit is set, timestamp events are inserted before each real event. The times-
tamps correspond to when the event happened on chip. When this bit is off, times-
tamps can still be read from the timestamp register. The timestamps would correspond
to when the event was dequeued in this scenario.
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