- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄379205 > IBM3206K0424 (IBM Microeletronics) IBM Processor for Network Resources(異步轉(zhuǎn)換模式（ATM）32位微處理器（用于網(wǎng)絡(luò)資源管理）) PDF資料下載
參數(shù)資料
| 型號： | IBM3206K0424 |
| 廠商： | IBM Microeletronics |
| 英文描述： | IBM Processor for Network Resources(異步轉(zhuǎn)換模式（ATM）32位微處理器（用于網(wǎng)絡(luò)資源管理）) |
| 中文描述： | IBM的處理器（異步轉(zhuǎn)換模式（ATM）的32位微處理器的網(wǎng)絡(luò)資源（用于網(wǎng)絡(luò)資源管理）） |
| 文件頁數(shù)： | 53/676頁 |
| 文件大?。?/td> | 9810K |
| 代理商： | IBM3206K0424 |
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IBM3206K0424
Preliminary
IBM Processor for Network Resources
pnr25.chapt02.01
August 14, 2000
ATM PHY Bus Interface
Page 53 of 676
1
FYRSOC
Input
Receive start of Cell
When using an external PHY, this signal indicates the start of
cell on the FYRDAT bus.
1
FYRCA
Input
Receive Cell Available
When using an external PHY, this indicates that a cell is avail-
able in the receive FIFO. When using an internal framer, this
signal is not used. When using a POS-PHY, this signal must be
connected to PRPA.
1
FYTCA
Input
Transmit Cell Available
When using an external PHY, this indicates that a cell is avail-
able in the PHY transmit FIFO. When using the internal framer,
this provides the TX HDLC interface signal, OFPtxT1Data.
When interfacing to POS-PHY, this signal should be connected
to PTPA.
1
FY
n
FUL
Input
PHY Transmit Full
When using an external PHY, this is asserted low by the PHY
when it can accept no more than four more data transfers
before it is full. This pin should be pulled up to the inactive state
when using a PHY that does not drive it. When using the inter-
nal framer, this provides the TX HDLC interface signal,
OFPtxT1DFrm. When using a POS-PHY interface, this signal
must be connected to STPA
1
FYEMP
Input
PHY Receive Empty
When using an external PHY, this is asserted low by the PHY
to indicate that in the current cycle there is no valid data for
delivery to the IBM3206K0424. When the PHY does not drive
FYEMP, this input should be tied to the inactive state. When
using the internal framer, this signal is not used. When using a
POS-PHY interface, this signal is connected to RVAL.
5
FYRADR(4-0)
Output
PHY Receive Address
When using an external PHY (Cell or POS-PHY based), this
address is used to select and poll up to 31 PHYs on the receive
side. Bits (1-0) are used to select which of the four PHYs and
bit two is used to indicate the null address. When bit two is B
’
1
’
,
bits 1-0 are also
’
1
’
. When bit 2 is
’
0
’
, bits 1-0 are
“
00
”
,
“
01
”
,
“
10
”
, or
“
11
”
.
5
FYTADR(4-0)
Output
PHY Transmit Address
When using an external PHY (Cell or POS-PHY based), this
address is used to select and poll up to 31 PHYs on the trans-
mit side. Bits (1-0) are used to select which of the four PHYs
and bit two is used to indicate the null address. When bit two is
’
1
’
, bits 1-0 are also
’
1
’
. When bit 2 is
’
0
’
, bits 1-0 are
“
00
”
,
“
01
”
,
“
10
”
, or
“
11
”
.
1
FYREOP
Input
PHY Receive EOP
When using an external POS-PHY, this signal indicates if the
FYRDATA (15-0) contains the last data of a packet. If the
external PHY is not a POS-PHY, this signal should be tied to
GND.
PHY Bus Pin Descriptions
(Page 2 of 3)
Quantity
Pin Name
Input/Output
Pin Function
Pin Description
Note:
Because some of the PHY transmit I/Os are used for receive framer functions and vice versa, there are some restrictions on how
the interfaces can be used.
1. If the transmit path is using an external PHY and the receive path is using the internal framer, FYTPAR(1) will assume the OOF
function and not be available as a parity output. This is only a concern if the PHY uses a 16-bit data interface and parity is being
used.
2. If the receive path is using an external PHY and the transmit path is using the internal framer, FYRPAR(1) will assume the OFPtx-
LPow function and not be available as a parity input. This is only a concern if the PHY uses a 16-bit data interface.
3. If the transmit path is using an external PHY and the receive path is using the internal framer, and the external PHY has a 16-bit
data interface, then the receive HDLC interface cannot be used. The three I/O for the RX HDLC interface will instead take on the
function of FYTDAT(15-13).
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