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參數(shù)資料
| 型號(hào)： | IBMN612404GT3B |
| 廠商： | IBM Microeletronics |
| 英文描述： | 128Mb Double Data Rate Synchronous DRAM(128M位高速CMOS同步動(dòng)態(tài)RAM（采用雙數(shù)據(jù)速率結(jié)構(gòu)）) |
| 中文描述： | 128Mb的雙數(shù)據(jù)速率同步DRAM（128兆位高速的CMOS同步動(dòng)態(tài)隨機(jī)存儲(chǔ)器（采用雙數(shù)據(jù)速率結(jié)構(gòu)）） |
| 文件頁(yè)數(shù)： | 25/79頁(yè) |
| 文件大?。?/td> | 1324K |
| 代理商： | IBMN612404GT3B |
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IBMN612404GT3B
IBMN612804GT3B
Preliminary
128Mb Double Data Rate Synchronous DRAM
06K0566.F39350B
1/01
IBM Corporation. All rights reserved.
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Page 25 of 79
Random Read Accesses: CAS Latencies (Burst Length = 2, 4 or 8)
DOa-n
CAS Latency = 2
Read
Read
Read
NOP
NOP
Read
DOa-b
DOa-n'
DOa-x
DOa-x'
DOa-b’
DOa-g
CK
CK
Command
Address
DQS
DQ
DO a-n, etc. = data out from bank a, column n etc.
n' etc. = odd or even complement of n, etc. (i.e., column address LSB inverted).
Reads are to active rows in any banks.
Shown with nominal t
AC
, t
DQSCK
, and t
DQSQ
.
Don’t Care
BAa, COL n
BAa, COL x
BAa, COL b
BAa, COL g
CL=2
DOa-n
CAS Latency = 2.5
Read
Read
Read
NOP
NOP
Read
DOa-b
DOa-n'
DOa-x
DOa-x'
DOa-b’
CK
CK
Command
Address
DQS
DQ
BAa, COL n
BAa, COL x
BAa, COL b
BAa, COL g
CL=2.5
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PDF描述 |
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