參數(shù)資料
型號(hào): ICS650G-40AT
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 時(shí)鐘產(chǎn)生/分配
英文描述: 189 MHz, OTHER CLOCK GENERATOR, PDSO16
封裝: 0.173 INCH, TSSOP-16
文件頁數(shù): 2/7頁
文件大?。?/td> 236K
代理商: ICS650G-40AT
ETHERNET SWITCH CLOCK SOURCE
MDS 650-40A B
2
Revision 121004
In te gr ated Circuit Systems 525 Ra ce Street, San Jose, CA 9512 6 tel (4 08) 297-1 201 www.icst.com
ICS650-40A
Pin Assignment
Output Select Table (MHz)
Pin Descriptions
1
2
3
X2
4
VDD
5
6
7
8
VDDOA
GNDB
OE
GNDA
16
X1/ICLK
VDD
15
14
13
12
11
10
9
16-pin (173 mil) TSSOP
CLKA
GNDA
S1
S0
GND
VDDOB
CLKB
S1
S0
CLKA
(MHz)
CLKA
(MHz)
CLKB
(MHz)
0
127
157
0
1
133
189
1
0
157
127
1
189
133
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
X1/ICLK
Input
Crystal or clock input. Connect to a 25 MHz crystal or single ended clock.
2
VDD
Power
Connect to +3.3 V.
3
GNDA
Power
Connect to ground.
4
VDDOA
Power
Connect to +2.5 V or +3.3 V. For CLKA outputs only.
5
CLKA
Output
Clock A output with weak pull-down resistor.
6
CLKA
Output
Clock A output with weak pull-down resistor.
7
GNDA
Power
Connect to ground.
8
S1
Input
Select pin 1.
9
S0
Input
Select pin 0.
10
GNDB
Power
Connect to ground.
11
CLKB
Output
Clock B output with weak pull-down resistor.
12
VDDOB
Power
Connect to +2.5 V or 3.3 V. For clock output B only.
13
GND
Power
Connect to ground.
14
OE
Input
Output enable tri-states outputs and device is not shut down. This input
has internal pull-up resistor. OE = 1 enables outputs A and B and OE=0
disables outputs A and B. When disabled the pull-down resistor pulls the
outputs to GND.
15
VDD
Power
Connect to +3.3 V.
16
X2
Output
Crystal connection. Leave unconnected for clock input.
ICS650-40A
ETHERNET SWITCH CLOCK SOURCE
TSD
IDT / ICS ETHERNET SWITCH CLOCK SOURCE
ICS650-40A
2
相關(guān)PDF資料
PDF描述
ICS650G-40T 189 MHz, OTHER CLOCK GENERATOR, PDSO16
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參數(shù)描述
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