參數(shù)資料
型號: ICS662M-03TR
元件分類: 時鐘及定時
英文描述: 662 SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8
封裝: 0.150 INCH, SOIC-8
文件頁數(shù): 2/6頁
文件大?。?/td> 128K
代理商: ICS662M-03TR
HDTV Audio/Video Clock Source
MDS 662-03 D
2
Revision 033005
Integrated Circuit Systems, Inc.
525 Race Street, San Jose, CA 95126 tel (408) 295-9800 www.icst.com
ICS662-03
Pin Assignment
8 pin (150 mil) SOIC
Output Clock Selection Table
Pin Descriptions
REF_IN
VDD
GND
S3
S2
S1
CLK
S0
1
2
3
4
8
7
6
5
S3
S2
S1
S0
Input
Frequency
(MHz)
Output
Frequency
(MHz)
0000
74.175824
8.192
0001
74.175824
11.2896
0010
74.175824
12.288
0011
74.175824
24.576
0100
74.175824
16.9344
0101
74.175824
18.432
0110
74.175824
36.864
0111
74.175824
27
1000
74.25
8.192
1001
74.25
11.2896
1010
74.25
12.288
1011
74.25
24.576
1100
74.25
16.9344
1101
74.25
18.432
1110
74.25
36.864
1111
74.25
27
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
REF_IN
Input
Connect this pin to a HDTV clock input.
2
VDD
Power
Connect to +3.3 V.
3
GND
Power
Connect to ground.
4
S2
Input
Output frequency selection. Determines output frequency per table above. On chip pull-up.
5
CLK
Output
Clock output.
6
S1
Input
Output frequency selection. Determines output frequency per table above. On chip pull-up.
7
S3
Input
Output frequency selection. Determines output frequency per table above. On chip pull-up.
8
S0
Input
Output frequency selection. Determines output frequency per table above. On chip pull-up.
相關(guān)PDF資料
PDF描述
ICS662M-03LF 662 SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8
ICS663MILF 663 SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8
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ICS664G-01 74.25 MHz, VIDEO CLOCK GENERATOR, PDSO16
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