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參數(shù)資料
| 型號： | ICS671-01 |
| 英文描述： | Zero Delay, Low Skew Buffer and Multipler |
| 中文描述： | 零延遲，低偏移緩沖區(qū)及乘數(shù) |
| 文件頁數(shù)： | 2/4頁 |
| 文件大?。?/td> | 42K |
| 代理商： | ICS671-01 |
ICS671-01
Zero Delay, Low Skew Buffer and Multipler
MDS 671-01 B
Integrated Circuit Systems, Inc. 525 Race Street San Jose CA95126 (408) 295-9800 tel www.icst.com
2
Revision 051700
Printed 11/15/00
Pin Descriptions
Number
1
2, 3, 6, 7,
10, 11
4, 13
5, 12
8
9
14
15
16
Key: I = Input; O = output; P = power supply connection.
Pin Assignment
ICS671-01
External Components
The ICS671-01 requires a minimum number of external components for proper operation. Decoupling
capacitors of 0.01μF should be connected between VDD and GND on pins 4 and 5, and VDD and GND
on pins 13 and 12, as close to the device as possible. A series termination resistor of 33
may be used close
to each clock output pin to reduce reflections.
16
15
14
13
12
11
10
9
16 pin narrow (150 mil) SOIC
1
2
3
4
5
6
7
8
CLK1
CLK2
GND
CLK3
CLK4
FBIN
CLK8
CLK7
CLKIN
VDD
S0
VDD
GND
CLK6
CLK5
S1
Name
CLKIN
Type
I
Description
Clock Input.
CLK1:6
VDD
GND
S0
S1
CLK7
CLK8
FBIN
O
P
P
I
I
I
I
I
Clock Outputs 1:6. See above table.
Power supply. Connect both pins to same voltage (either 3.3 V or 5 V).
Connect to ground.
Select input 0. See table above.
Select input 1. See table above.
Clock Output 7. See table above.
Clock Output 8. See table above. Normally use this clock as feedback.
Feedback Input. Connect to CLK8 under normal operations.
S1
0
0
1
1
S0
0
1
0
1
CLK1:6
CLK7
CLK8
Input range
-
5 to 30 MHz
15 to 80 MHz
7.5 to 40 MHz
Tri-state (high impedance)
x2
x2
x4
Tri-state (high impedance)
x5
x2
x4
Tri-state (high impedance)
x1
x2
x4
Output Clock Mode Select Table
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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