參數(shù)資料
型號： IDT5T929
廠商： Integrated Device Technology, Inc.
英文描述： PRECISION CLOCK GENERATOR OC-48 APPLICATIONS
中文描述： 精密時鐘發(fā)生器的OC - 48應用
文件頁數(shù)： 6/8頁
文件大?。?/td> 60K
代理商： IDT5T929
6
INDUSTRIAL TEMPERATURE RANGE
IDT5T929
PRECISION CLOCK GENERATOR OC-48 APPLICATIONS
DC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE FOR LVDS
Symbol
Input Characteristics
Parameter
Test Conditions
Min.
Typ.
Max.
Unit
I
IN
V
CM
V
DIF
Output Characteristics
Input Current (CLKIN, REFIN)
Common Mode Input Voltage Range
(1)
Differential Voltage Required to Toggle Input
V
DD
= 3.465V
-20
0.9
100
—
—
—
+20
μ
A
V
mV
V
DD
- 0.05
—
V
OT(+)
V
OT(-)
V
OT
V
OS
V
OS
I
OS
I
OSD
Differential Output Voltage for the TRUE Binary State
Differential Output Voltage for the FALSE Binary State
Change in V
OT
Between Complementary Output States
Output Common Mode Voltage (Offset Voltage)
Change in V
OS
Between Complementary Output States
Outputs Short Circuit Current
Differential Outputs Short Circuit Current
247
-247
—
1.125
—
—
—
—
—
—
1.2
—
9
6
454
-454
50
1.375
50
24
12
mV
mV
mV
V
mV
mA
mA
V
OUT(+)
and V
OUT(-)
= 0V
V
OUT(+)
= V
OUT(-)
NOTE:
1. Not to exceed V
DD
- 0.05V.
INPUT TIMING REQUIREMENTS
Symbol
Parameter
REF
H
Input Reference Clock Duty Cycle
F
REF
Input Reference Clock Range
REF
TOL
Input Reference Clock Frequency Tolerance
F
CLKIN
Clock in Frequency Range
CLKIN
H
Clock in Duty Cycle
t
AQ
Acquisition Time fromReturn of Valid CLKIN
LOCK
TOL
Frequency Tolerance for LOCK
t
JIT
(
TOL
)
Tolerance to Input Jitter
Min.
40
19.44
-100
19.44
40
—
-600
Typ.
50
—
—
—
50
60
±450
Max.
60
666.52
100
666.52
60
150
600
Unit
%
MHz
ppm
MHz
%
us
ppm
GR-253 Sect. 5.6.2.2
NOTE:
1. All input frequencies permtted by PLL bandwidth.
Symbol
Q
OUT
Parameter
Multiplied Clock Output Frequency
Min.
155.52
622.08
19.44
19.44
—
—
—
—
—
250
—
—
—
—
45
Typ.
—
—
—
—
150
100
150
100
10
305
0.05
0.4
0.8
1.2
—
Max.
166.63
666.52
666.52
667
—
—
—
—
20
500
0.1
1
3.4
3.5
55
Unit
MHz
SELmode = LOW
SELmode = HIGH
Q
REG
CLKIN
t
R
Regenerated Clock Output Frequency
Input Clock Frequency
Output Rise Time
MHz
MHz
ps
LVPECL
LVDS
LVPECL
LVDS
t
F
Output Fall Time
ps
t
SK
Skew between Q
OUT
and Q
REG
PLL Bandwidth
Jitter Transfer Peaking
ps
KHz
dB
PLLBW
t
P
Output frequency = 622MHz - 666.5MHz
Output frequency = 155.5MHz - 166.6MHz
Output frequency = 77.7MHz - 83.4MHz
t
J
Jitter Generation
(1)
(with 12KHz to 20MHz filter)
Output Duty Cycle
ps (RMS)
t
DUTY
%
AC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE
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PDF描述
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