參數(shù)資料
型號： IDT5T940-10NLI
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘及定時
英文描述： PRECISION CLOCK GENERATOR OC-192 APPLICATIONS
中文描述： 5T SERIES, PLL BASED CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC28
封裝： PLASTIC, VFQFPN-28
文件頁數(shù)： 8/10頁
文件大?。?/td> 68K
代理商： IDT5T940-10NLI
8
INDUSTRIAL TEMPERATURE RANGE
IDT5T940
PRECISION CLOCK GENERATOR OC-192 APPLICATIONS
Symbol
Parameter
Min.
155.52
155.52
622.08
19.44
19.44
—
—
—
—
—
65
250
—
—
—
—
45
Typ.
—
—
—
—
—
150
100
150
100
10
80
305
0.05
0.1
0.4
0.5
—
Max.
166.63
666.52
666.52
666.52
667
—
—
—
—
20
120
500
0.1
0.3
1.5
1.7
55
Unit
SELmode = LOW
SELmode = MID
SELmode = HIGH
Q
OUT
Multiplied Clock Output Frequency
MHz
Q
REG
CLKIN
t
R
Regenerated Clock Output Frequency
Input Clock Frequency
Output Rise Time
MHz
MHz
ps
LVPECL
LVDS
LVPECL
LVDS
t
F
Output Fall Time
ps
t
SK
Skew between Q
OUT
and Q
REG
PLL Bandwidth Setting
ps
KHz
PLLBW
t
P
Jitter Transfer Peaking
dB
Output frequency = 622MHz - 666.5MHz
Output frequency = 155.5MHz - 166.6MHz
Output frequency = 77.7MHz - 83.4MHz
t
J
Jitter Generation
(with 12KHz to 20MHz filter)
(1)
Output Duty Cycle
ps (RMS)
t
DUTY
%
AC ELECTRICAL CHARACTERISTICS OV ER OPERATING RANGE (OC-48)
Symbol
Parameter
Min.
155.52
155.52
622.08
19.44
19.44
—
—
—
—
—
65
250
1000
—
—
—
—
45
Typ.
—
—
—
—
—
150
100
150
100
10
80
305
1250
0.05
0.3
0.4
0.5
—
Max.
166.63
666.52
666.52
666.52
667
—
—
—
—
20
120
500
2000
0.1
1.1
1.3
1.6
55
Unit
SELmode = LOW
SELmode = MID
SELmode = HIGH
Q
OUT
Multiplied Clock Output Frequency
MHz
Q
REG
CLKIN
t
R
Regenerated Clock Output Frequency
Input Clock Frequency
Output Rise Time
MHz
MHz
ps
LVPECL
LVDS
LVPECL
LVDS
t
F
Output Fall Time
ps
t
SK
Skew between Q
OUT
and Q
REG
ps
PLLBW
PLL Bandwidth Setting
KHz
t
P
Jitter Transfer Peaking
dB
Output frequency = 155.5MHz - 166.6MHz
Output frequency = 77.7MHz - 83.4MHz
Output frequency = 19.4MHz - 20.9MHz
t
J
Jitter Generation
(with 3KHz to 5MHz filter)
(1)
Output Duty Cycle
ps (RMS)
t
DUTY
%
AC ELECTRICAL CHARACTERISTICS OV ER OPERATING RANGE (OC-12)
NOTE:
1. All input frequencies and PLLBW
[1:0]
permtted by PLL Bandwidth Selection table.
NOTE:
1. All input frequencies and PLLBW
[1:0]
permtted by PLL Bandwidth Selection table.
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PDF描述
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