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參數(shù)資料
| 型號： | IDT723633L15PF |
| 廠商： | 濟南固锝電子器件有限公司 |
| 英文描述： | Quad, High Slew Rate, Single-Supply, Op Amp 14-SOIC -40 to 105 |
| 中文描述： | 的CMOS總線匹配SyncFIFOTM 256 × 36，512 × 36，1024 × 36 |
| 文件頁數(shù)： | 24/28頁 |
| 文件大?。?/td> | 286K |
| 代理商： | IDT723633L15PF |
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24
COMMERCIAL TEMPERATURE RANGE
IDT723623/723633/723643 BUS-MATCHING SyncFIFO
256 x 36, 512 x 36, 1,024 x 36
NOTES:
1. t
SKEW1
is the mnimumtime between a rising CLKB edge and a rising CLKA edge for
FF
to transition HIGH in the next CLKA cycle. If the time between the rising CLKB edge
and rising CLKA edge is less than t
SKEW1
, then
FF
may transition HIGH one CLKA cycle later than shown.
2. If Port B size is word or byte, t
SKEW1
is referenced fromthe rising CLKB edge that reads the last word or byte of the long word, respectively.
Figure 14.
FF
Flag Timing and First Available Write when FIFO is Full (IDT Standard Mode)
NOTES:
1. t
SKEW2
is the mnimumtime between a rising CLKA edge and a rising CLKB edge for
AE
to transition HIGH in the next CLKB cycle. If the time between the rising CLKA edge
and rising CLKB edge is less than t
SKEW2
, then
AE
may transition HIGH one CLKB cycle later than shown.
2. FIFO Write (
CSA
= LOW, W/
R
A = LOW, MBA = LOW), FIFO read (
CSB
= LOW,
W
/RB = HIGH, MBB = LOW). Data in the FIFO output register has been read fromthe FIFO.
3. If Port B size is word or byte,
AE
is set LOW by the last word or byte read fromthe FIFO, respectively.
Figure 15. Timing for
AE
when the FIFO is Almost-Empty (IDT Standard and FWFT Modes).
AE
CLKA
ENB
3269 drw16
ENA
CLKB
2
1
t
ENS2
t
ENH
t
SKEW2
(1)
t
PAE
t
PAE
t
ENS2
t
ENH
X Word in FIFO
(X+1) Words in FIFO
CSB
EF
W
/RB
MBB
ENB
B0-B35
CLKB
FF
CLKA
CSA
3269 drw15
W/
R
A
A0-A35
MBA
ENA
1
2
t
CLK
t
CLKH
t
CLKL
t
ENS2
t
ENH
t
A
t
SKEW1
t
CLK
t
CLKL
t
ENS2
t
ENS2
t
DS
t
ENH
t
ENH
t
DH
To FIFO
Previous Word in FIFO Output Register
Next Word From FIFO
LOW
HIGH
LOW
HIGH
LOW
HIGH
(1)
FIFO Full
WFF
WFF
t
t
t
CLKH
相關PDF資料 |
PDF描述 |
|---|---|
| IDT723623 | High-Slew-Rate, Single-Supply Operational Amplifier 8-PDIP -40 to 105 |
| IDT723623L12 | CMOS BUS-MATCHING SyncFIFOTM 256 x 36, 512 x 36, 1,024 x 36 |
| IDT723643 | HIGH-SLEW-RATE, SINGLE-SUPPLY OPERATIONAL AMPLIFIERS 14-SOIC 0 to 70 |
| IDT723643L12 | HIGH-SLEW-RATE, SINGLE-SUPPLY OPERATIONAL AMPLIFIERS 14-PDIP 0 to 70 |
| IDT723643L12PF | HIGH-SLEW-RATE, SINGLE-SUPPLY OPERATIONAL AMPLIFIERS 14-PDIP 0 to 70 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| IDT723633L15PF8 | 功能描述:IC FIFO SYNC 512X36 128-TQFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標準包裝:90 系列:7200 功能:同步 存儲容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應商設備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF |
| IDT723634L12PF | 功能描述:IC FIFO SYNC 512X36X2 128QFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標準包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應商設備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
| IDT723634L12PF8 | 功能描述:IC FIFO SYNC 512X36X2 128QFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標準包裝:90 系列:7200 功能:同步 存儲容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應商設備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF |
| IDT723634L15PF | 功能描述:IC FIFO SYNC 512X36X2 128QFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標準包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應商設備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
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