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參數(shù)資料
| 型號： | IDT72T51546L5BB |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | 2.5V MULTI-QUEUE FLOW-CONTROL DEVICES (32 QUEUES) 36 BIT WIDE CONFIGURATION 1,179,648 bits and 2,359,296 bits |
| 中文描述： | 32K X 36 OTHER FIFO, 3.6 ns, PBGA256 |
| 封裝： | 17 X 17 MM, 1 MM PITCH, PLASTIC, BGA-256 |
| 文件頁數(shù)： | 14/64頁 |
| 文件大?。?/td> | 639K |
| 代理商： | IDT72T51546L5BB |
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14
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72T51546/72T51556 2.5V, MULTI-QUEUE FLOW-CONTROL DEVICES
(32 QUEUES) 36 BIT WIDE CONFIGURATION 1,179,648 and 2,359,296 bits
Symbol
V
TERM
Rating
Commercial
–0.5 to +3.6
(2)
Unit
V
Termnal Voltage
with respect to GND
T
STG
Storage Temperature
–55 to +125
°
C
–50 to +50 mA
I
OUT
DC Output Current
Symbol
V
CC
GND
V
IH
Parameter
Min.
2.375
0
1.7
V
REF
+0.2
V
REF
+0.2
-0.3
—
—
0.8
0.68
Typ.
2.5
0
—
—
—
—
—
—
0.9
0.75
Max.
2.625
0
3.45
—
—
0.7
V
REF
-0.2
V
REF
-0.2
1.0
0.9
Unit
V
V
V
V
V
V
V
V
V
V
°
C
°
C
Supply Voltage
Supply Voltage
Input High Voltage
LVTTL
eHSTL
HSTL
LVTTL
eHSTL
HSTL
eHSTL
HSTL
V
IL
Input Low Voltage
V
REF
(HSTL only)
Voltage Reference Input
T
A
Operating Temperature Commercial
0
—
70
T
A
Operating Temperature Industrial
-40
—
85
ABSOLUTE MAXIMUM RATINGS
RECOMMENDED DC OPERATING CONDITIONS
NOTES:
1. Stresses greater than those listed under ABSOLUTE MAXIMUMRATINGS may cause
permanent damage to the device. This is a stress rating only and functional operation
of the device at these or any other conditions above those indicated in the operational
sections of this specification is not implied. Exposure to absolute maximumrating
conditions for extended periods may affect reliability.
2. Compliant with JEDEC JESD8-5. V
CC
termnal only.
Symbol
Parameter
(1)
Conditions
Max.
Unit
C
IN
(2,3)
Input
V
IN
= 0V
10
(3)
pF
Capacitance
Output
Capacitance
C
OUT
(1,2)
V
OUT
= 0V
15
pF
CAPACITANCE
(T
A
= +25
°
C, f = 1.0MHz)
NOTES:
1. With output deselected, (
OE
≥
V
IH
).
2. Characterized values, not currently tested.
3. C
IN
for Vref is 20pF.
NOTE:
1. V
REF
is only required for HSTL or eHSTL inputs. V
REF
should be tied LOW for LVTTL operation.
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PDF描述 |
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