參數(shù)資料
型號： IDT72T51556L6BB
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： 2.5V MULTI-QUEUE FLOW-CONTROL DEVICES (32 QUEUES) 36 BIT WIDE CONFIGURATION 1,179,648 bits and 2,359,296 bits
中文描述： 64K X 36 OTHER FIFO, 3.7 ns, PBGA256
封裝： 17 X 17 MM, 1 MM PITCH, PLASTIC, BGA-256
文件頁數(shù)： 58/64頁
文件大?。?/td> 639K
代理商： IDT72T51556L6BB
58
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72T51546/72T51556 2.5V, MULTI-QUEUE FLOW-CONTROL DEVICES
(32 QUEUES) 36 BIT WIDE CONFIGURATION 1,179,648 and 2,359,296 bits
WRADD
WADEN
WCLK
WEN
FSTR
PAF
n
FSYNC
FF
PAF
SCLK
RCLK
REN
ESTR
PAE
n
ESYNC
OV
PAE
RDADD
RADEN
SO FXO EXO
SI
FXI EXI
WRADD
WADEN
WCLK
WEN
FSTR
PAF
n
FSYNC
FF
PAF
SCLK
RCLK
REN
ESTR
PAE
n
ESYNC
OV
PAE
RDADD
RADEN
SO FXO
EXO
SI FXI
EXI
WRADD
WADEN
WCLK
WEN
FSTR
PAF
n
FSYNC
FF
PAF
SCLK
RCLK
REN
ESTR
PAE
n
ESYNC
OV
PAE
RDADD
RADEN
SENO
FXO EXO
Q0-Q35
SI
FXI
EXI
Data Bus
Write Clock
Write Enable
Write Queue Select
Full Strobe
Programmable Almost Full
Write Address
Full Sync1
Full Flag
Almost Full Flag
Serial Clock
Output Data Bus
Read Clock
Read Enable
Read Queue Select
Empty Strobe
Programmable Almost Empty
Read Address
Empty Sync 1
Output Valid Flag
Almost Empty Flag
Serial Programming Data Input
DEVICE
1
DEVICE
2
DEVICE
n
Full Sync2
Empty Sync 2
Full Sync n
Empty Sync n
SENO
SENI
DONE
5998 drw40
D0-D35
Q0-Q35
D0-D35
D0-D35
Q0-Q35
SENI
PR
Packet
Reads
PR
PR
Serial Enable
SENO
SENI
Figure 35. Multi-Queue Expansion Diagram
NOTES:
1. If devices are configured for Direct operation of the
PAF
n/
PAE
n flag busses the FXI/EXI of the MASTER device should be tied LOW. All other devices tied HIGH. The FXO/EXO
outputs are DNC (Do Not Connect).
2. Q outputs must not be mxed between devices, i.e. Q0 of device 1 must connect to Q0 of device 2, etc.
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PDF描述
IDT72T51556L6BBI 2.5V MULTI-QUEUE FLOW-CONTROL DEVICES (32 QUEUES) 36 BIT WIDE CONFIGURATION 1,179,648 bits and 2,359,296 bits
IDT72T51546 2.5V MULTI-QUEUE FLOW-CONTROL DEVICES (32 QUEUES) 36 BIT WIDE CONFIGURATION 1,179,648 bits and 2,359,296 bits
IDT72T51546L5BB 2.5V MULTI-QUEUE FLOW-CONTROL DEVICES (32 QUEUES) 36 BIT WIDE CONFIGURATION 1,179,648 bits and 2,359,296 bits
IDT74ALVCH16501 3.3V CMOS 18-BIT UNIVERSAL BUS TRANSCEIVER WITH 3-STATE OUTPUTS AND BUS-HOLD
IDT74H16501PA 3.3V CMOS 18-BIT UNIVERSAL BUS TRANSCEIVER WITH 3-STATE OUTPUTS AND BUS-HOLD
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參數(shù)描述
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IDT72T54242L6-7BB 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標準包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433
IDT72T54242L6-7BBI 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標準包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433
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