參數(shù)資料
型號(hào): IDTCV110LPV
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: XO, clock
英文描述: PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
中文描述: 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
封裝: SSOP-56
文件頁數(shù): 8/16頁
文件大?。?/td> 100K
代理商: IDTCV110LPV
COMMERCIAL TEMPERATURE RANGE
8
IDTCV110L
PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
IDT CONFIDE NT IAL
BY TE 7
Bit
Output(s) Affected
Description / Function
Vendor ID
Vendor ID
Vendor ID
Vendor ID
Revision ID
Revision ID
Revision ID
Revision ID
0
1
Type
R
R
R
R
R
R
R
R
Power On
1
0
1
0
0
1
1
0
0
1
2
3
4
5
6
7
BY TE 6
Bit
Output(s) Affected
CPU[2:0]
CPU[2:0]
CPU[2:0]
PCI, SRC
Description / Function
FSA latched value on power up
FSB latched value on power up
FSC latched value on power up
Software PCI_STOP control for
PCI and SRC CLK
0
1
Type
R
R
R
RW
Power On
0
1
2
3
Stop all PCI, PCIF, and
SRC which can be stopped
by PCI_STOP#
1x drive
Software STOP
Disabled
1
4
5
6
REF
Reserve
REF drive strength
2x drive
1
0
0
Test clock mode entry control
Normal operation
Test mode, controlled
by Byte 6, Bit 7
REF/N
RW
7
CPU, SRC, PCI
PCIF, REF,
USB48, DOT96
Only valid when Byte 6, Bit 7
is HIGH
Hi-Z
0
BY TE 8
Bit
Output(s) Affected
One cycle read
Description / Function
0
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
Power On
0
0
0
0
0
0
0
1
0
1
2
3
4
5
6
7
disable
Disable
enable
enable
N Programmng enable
Reserve
USB48
USB 48 Strength control
USB PLL power down
SRC PLL power down
CPU PLL power down
Only valid when Byte1 bit0 is 1
1x
2x
normal
normal
normal
disable
Power down
Power down
Power down
enable
SRC, PLL2, SSC enable
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PDF描述
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參數(shù)描述
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