參數(shù)資料
型號(hào)： IDTCV123PV
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： XO, clock
英文描述： PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
中文描述： 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
封裝： SSOP-56
文件頁(yè)數(shù)： 2/16頁(yè)
文件大?。?/td> 89K
代理商： IDTCV123PV
COMMERCIAL TEMPERATURE RANGE
2
IDTCV123
PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
PIN CONFIGURATION
Symbol
V
DDA
V
DDIN
T
STG
T
AMBIENT
T
CASE
ESD Prot
Description
Mn
Max
4.6
4.6
+150
+70
+115
Unit
V
V
°C
°C
°C
V
3.3V Core Supply Voltage
3.3V Logic Input Supply Voltage GND - 0.5
Storage Temperature
Ambient Operating Temperature
Case Temperature
Input ESD Protection
Human Body Model
–65
0
2000
ABSOLUTE MAX IMUM RATINGS
(1)
NOTE:
1. Stresses greater than those listed under ABSOLUTE MAXIMUMRATINGS may cause
permanent damage to the device. This is a stress rating only and functional operation
of the device at these or any other conditions above those indicated in the operational
sections of this specification is not implied. Exposure to absolute maximumrating
conditions for extended periods may affect reliability.
SSOP
TOP VIEW
56
55
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
REF0/FSC
GND_REF
X1
X2
SDAT
SCL
GND_CPU
V
DD
_REF
CPU0
CPU0#
V
DD
_CPU
CPU1
CPU1#
IREF
CPU_ITP#/SRC6#
V
DD
_SRC
SRC5
SRC5#
GND_SRC
SRC4#
SRC3
SRC3#
V
DD
_SRC
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
PCI0
PCI1
PCI3
PCI4
PCI5
GND_PCI
V
DD
_PCI
V
TT
_P
WRGD#
/
PD
V
DD
48
USB48/FSB
GND
48
DOT96
DOT96#
SRC1
SRC1#
V
DD
_SRC
SRC2
SRC2#
SATA_SRC
SATA_SRC#
SRC4
GND_PCI
V
DD
_PCI
PCI2
*TEST_SEL/PCIF0
ITP_EN/PCIF1
SRC0
SRC0#
GND_SRC
CPU_ITP/SRC6
REF1/FSA
GND_A
V
DD
_A
FREQUENCY SELECTION TABLE
FSC, B, A
CPU Mode, MHz
101
100
001
133
011
166
010
200
000
266
100
333
110
400
111
Reserve
SRC4
100
100
100
100
100
100
100
100
SRC[3:1], SRC[7:5]
100
100
100
100
100
100
100
100
PCI
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
USB
48
48
48
48
48
48
48
48
DOT96
96
96
96
96
96
96
96
96
REF
14.318
14.318
14.318
14.318
14.318
14.318
14.318
14.318
ITP_EN
1
0
pin 38
CPUC2_ITP
SRCC6
pin 39
CPUT_ITP
SRCT6
TEST CLARIFICATION TABLE
HW
SW
TEST_SEL/ TEST SELECT
PCICLK_F0
0
1
BIT B6b6
0
X
OUTPUT
Normal
Hi-Z
Comments
Normal Operation
Power-up with TEST_SEL =1 to
enter test mode. Cycle power with
TEST_SEL = 0 to disable test mode
If TEST_SEL HW pin is 0 during
power-up, test mode can be invoked
through B6b6. Cycle power with
TEST_SEL = 0 to disable test mode.
0
1
Hi-Z
*= Internal pull down
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