參數(shù)資料
型號(hào): ISPGDX160VA-7Q208
廠商: LATTICE SEMICONDUCTOR CORP
元件分類: PLD
英文描述: In-System Programmable 3.3V Generic Digital CrosspointTM
中文描述: EE PLD, 7 ns, PQFP208
封裝: PLASTIC, QFP-208
文件頁(yè)數(shù): 19/37頁(yè)
文件大?。?/td> 464K
代理商: ISPGDX160VA-7Q208
19
Specifications
ispGDX160V
External Timing Parameters (Continued)
2
8
0
10
4
20
30
40
50
60
70
I/O Cell Fanout
6
10
4
ispGDX160V Maximum
GRP Delay vs. I/O Cell Fanout
ispGDX160V timings are specified with a GRP load
(fanout) of four I/O cells. The figure below shows the
GRP Delay with increased GRP loads. These deltas
apply to any signal path traversing the GRP (MUXA-D,
OE, CLK/CLKEN, MUXsel0-1). Global Clock signals
which do not use the GRP have no fanout delay adder.
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PDF描述
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參數(shù)描述
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