參數(shù)資料
型號: ISPGDX80VA-7T100I
廠商: LATTICE SEMICONDUCTOR CORP
元件分類: PLD
英文描述: PHOTOELECTRIC PRODUCTS
中文描述: EE PLD, 7 ns, PQFP100
封裝: TQFP-100
文件頁數(shù): 13/27頁
文件大?。?/td> 346K
代理商: ISPGDX80VA-7T100I
13
Specifications
ispGDX80VA
External Timing Parameters (Continued)
1.0
0.0
0 4 10
20
30
40
50
60
70
0.2
0.4
0.6
0.8
1.2
1.4
1.6
I/O Cell Fanout
ispGDX80VA Maximum
GRP Delay vs. I/O Cell Fanout
ispGDX80VA timings are specified with a GRP load
(fanout) of four I/O cells. The figure below shows the
GRP Delay with increased GRP loads. These deltas
apply to any signal path traversing the GRP (MUXA-D,
OE, CLK/CLKEN, MUXsel0-1). Global Clock signals
which do not use the GRP have no fanout delay adder.
相關PDF資料
PDF描述
ISPGDX80VA-9T100I In-System Programmable 3.3V Generic Digital CrosspointTM
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相關代理商/技術參數(shù)
參數(shù)描述
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ISPGDXTMFAMILY 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:In-System Programmable Generic Digital CrosspointTM