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參數(shù)資料
| 型號(hào)： | IXF440 |
| 英文描述： | LAN HUB CONTROLLER |
| 中文描述： | 局域網(wǎng)集線器控制器 |
| 文件頁(yè)數(shù)： | 87/100頁(yè) |
| 文件大?。?/td> | 1354K |
| 代理商： | IXF440 |
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IXF440 Multiport 10/100 Mbps Ethernet Controller
Datasheet
87
8.7.2.3
Timing Parameters
Table 30
lists the CPU bus clock timing parameters.
8.8
MII/SYM Port Specifications
The MII/SYM port electrical specifications are compliant with the IEEE 802.3 Standard.
8.8.1
DC Specifications
Table 31
lists the MII/SYM port DC specifications.
8.8.2
Signals Timing
This section describes the timing diagram of the MII/SYM port.
Table 30. Timing Parameters
Symbol
Parameter
Minimum
Maximum
Tcas
Tcah
Tcrr
Tcrh
Tcdrs
Tcdrh
Tcdrd
Tci
Tcwl
Tcwh
Tcdws
Tcdwh
Tcdwd
Tcyd
Trtw
Twtr
cadd[9:0], cps[2:0], cs_l setup time
cadd[9:0], cps[2:0], cs_l hold time
crdy_l assertion to crd_l deassertion
crd_l high width
cdat[7:0] to crdy_l setup time
crd_l to cdat[7:0] hold time
Read cdat[7:0] driving delay
crd_l to cint_l clear delay
cwr_l low width
crdy_l to cwr_l hold time
cdat[7:0] to cwr_l setup time
crdy_l to cdat[7:0] hold time
Write cdat[7:0] latching delay
crdy_l width in write cycle
Read crdy_l deassertion to cwr_l assertion
Write crdy_l deassertion to crd_l assertion
10 ns
10 ns
10 ns
3
×
TC
1
10 ns
TC
3
×
TC
—
3
×
TC
2
×
TC
10 ns
10 ns
2
×
TC
4
×
TC
4
×
TC
4
×
TC
—
—
—
—
—
4
×
TC
15
×
TC
5
×
TC
—
—
—
—
4
×
TC
4
×
TC
—
—
1. TC is the IX Bus clock cycle time.
Table 31. MII/SYM Port DC Specifications
Symbol
Parameter
Condition
Minimum
Maximum
Vih
Input high voltage
—
2 V
—
Vil
Input low voltage
—
—
0.8 V
Voh
Output high voltage
Ioh =
–
4 mA
2.4 V
—
Vol
Output low voltage
Iol = 4 mA
—
0.4 V
Ii
Input leakage current
—
–
15 μA
15 μA
Cin
Pin capacitance
—
5 pF
10 pF
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PDF描述 |
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