參數(shù)資料
型號(hào)： IXF6048
英文描述： Telecommunication IC
中文描述： 通信集成電路
文件頁(yè)數(shù)： 186/352頁(yè)
文件大?。?/td> 4545K
代理商： IXF6048
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IXF6048
—
51/155/622/2488 Mbit/s SONET/SDH Cell/Packet Interface
186
Datasheet
After the transmit HDLC controller reads the last word of a POS-packet from the transmit FIFO,
the FIFO can be empty. This is not a transmit FIFO underflow: after writing the last word of a POS-
packet, the Link Layer device is not required to write a new POS-packet immediately.
A transmit FIFO underflow occurs when the HDLC controller tries to read an empty FIFO (when
reading a POS-packet). A transmit FIFO underflow occurs when the Link Layer device fails to
keep up with the outgoing HDLC frame traffic (i.e., the SPE rate). If frame intrafilling is not
enabled (XmtFifEn =
’
0
’
in R_PHCCNF), when the transmit FIFO underflows, the HDLC
controller aborts the current HDLC frame, finishing the frame with an Abort sequence.If frame
intrafilling is enabled, the HDLC controller inserts pairs of Control Escape characters until new
data is available.
While the transmit FIFO is empty, the HDLC controller maps Flag characters into the SPE
(interframe filling) and waits for the Link Layer device to write a new POS-packet into the FIFO.
The HDLC controller starts reading (and transmitting) the new POS-packet as soon as the transmit
FIFO contains a number of words equal to or greater than XmtIML[3:0] (register T_PUICNF).
XmtIML[3:0] (transmit initiation minimum level) is used to avoid consecutive FIFO underflows
(to recover after an underflow condition).
7.2.2
Address and Control Fields
When the POS-packet is the HDLC information field (XmtACPass =
’
0
’
, Register T_PHCCNF),
the HDLC controller generates the following Address and Control fields:
Address = FFH (All-stations address)
Control = 03H (Unnumbered Information command with the Poll/Final bit set to
’
0
’
)
When the POS-packet is the HDLC
“
Address + Control + information
”
fields (XmtACPass = '1',
Register T_PHCCNF), the HDLC controller transmits the Address and Control fields read from the
FIFO.
7.2.3
FCS Generation/Insertion
The Frame Check Sequence (FCS) field is calculated over all bits of the Address, Control,
Protocol, Information, and Padding fields, not including the Flag Sequences nor the FCS field
itself. The FCS field is calculated before Control Escape insertion (before byte stuffing). The FCS
is transmitted least significant octet first, which contains the coefficient of the highest term. Two
different generating polynomials are defined, the CRC-CCITT (CRC-16)
g(X) = 1 + X
5
+ X
12
+ X
16
and the CRC-32:
g(X) = 1 + X + X
2
+ X
4
+ X
5
+ X
7
+ X
8
+ X
10
+ X
11
+ X
12
+ X
16
+ X
22
+ X
23
+ X
26
+ X
32
XmtFCSCnf[1:0] (register T_PHCCNF) configures the use of CRC-CCITT, CRC-32, or no-FCS
generation.
The transmit HDLC controller allows insertion of FCS errors by inverting the calculated FCS field
before transmission. This can be done by software control (XmtFCSErrCnf and XmtFCSErr,
register T_PHCCNF)
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PDF描述
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