參數(shù)資料
型號(hào)： IXF6048
英文描述： Telecommunication IC
中文描述： 通信集成電路
文件頁數(shù)： 292/352頁
文件大小： 4545K
代理商： IXF6048
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IXF6048
—
51/155/622/2488 Mbit/s SONET/SDH Cell/Packet Interface
292
Datasheet
11.8.3
T_SC_MSOH
—
Transmit Source Configuration for MSOH Bytes
Register ((1cc)E2H)
Bit
Name
Description
Type
Default
15:14
MstRdiOnHystCnf
g[1:0]
Configure the hysteresis of MST RDI when inserted into the transmit K2
byte following either the detection of a receiver defect or its activation
via either the TSAL input alarm bus or the microprocessor (see
XmtMstRdiSrc configuration bit):
’
11
’
= Transmitted K2 RDI remains stable at least for 20 frames
’
10
’
= Transmitted K2 RDI remains stable at least for 10 frames
’
01
’
= Transmitted K2 RDI remains stable at least for 5 frames
’
00
’
= Transmitted K2 RDI remains stable at least for 1 frame.
R/W
’
10
’
13:12
XmtMstReiSrc
[1:0]
These bits specify the source of the transmitted M1 REI bits when
XmtPrcMsohSrc bit is set to
’
0
’
AND
TSOHINS input pin is disabled
(TSOHINS_Ena =
‘
0
’
in register T_SC_RSOH[15]) or active-low on M1
time slot in TSOH serial bus input. It is
ignored in regenerator
configuration
—
the received byte is passed through
.
'00' = Hardware supplied REI (Feedback of received B2 errors as Bit or
Block: see configuration register R_MST_C.
'01' = Serial transmit Section Alarm bus, TSAL input pin.
'1X' = REI bits are set to '0's (disabled).
R/W
'00'
11:10
XmtMstRdiSrc
[1:0]
The source of the MST RDI bits (K2[2:0] = '110') are defined by these
bits
when the transmit MstRdi default is active (a Remote Defect
Indication has to be sent to the remote end), XmtPrcMsohSrc bit is
set to '0' AND TSOHINS input pin is disabled (TSOHINS_Ena =
‘
0
’
in
register T_SC_RSOH[15])
or active-low
on K2 time slot in TSOH serial
bus input. In any other case, the source of the K2[2:0] bits is specified
by XmtK2ApsSrc configuration bit.
It is
ignored in regenerator
configuration
—
the received byte is
passed through
.
'00' = Hardware supplied MST RDI bits (internal feedback from the
receiver major defects: see configuration register R_MST_C. It is also
possible in this configuration to force a transmit RDI defect via the
microprocessor (see register R_MST_C, bit #1).
'01' = Serial Transmit Section Alarm bus, TSAL input pin.
'1X' = Microprocessor supplied RDI (all K2 bits set to register (1cc)B5H
value)
R/W
'00'
9
XmtK2ApsSrc
This bit specifies the source of the transmitted K2-APS byte when
XmtPrcMsohSrc bit is set to '0', the transmit MstRdi default is not active
(no Remote Defect Indication),
AND
TSOHINS input pin is disabled
(TSOHINS_Ena =
‘
0
’
in register T_SC_RSOH[15]) or active-low on K2
time slot in TSOH serial bus input. It is
ignored in regenerator
configuration
—
the received byte is passed through
.
'1' = Serial Transmit Section Alarm bus, TSAL input pin.
'0' = Microprocessor (internal register MP_TK2K1).
See also XmtMstRdiSrc configuration bit for the K2[2:0] bits
R/W
'0'
8
XmtK1Src
This bit specifies the source of the transmitted K1 byte when
XmtPrcMsohSrc bit is set to '0'
and
TSOHINS input pin is disabled
(TSOHINS_Ena =
‘
0
’
in register T_SC_RSOH[15]) or active-low on K1
time slot in TSOH serial bus input. It is
ignored in regenerator
configuration
—
the received byte is passed through
:
'1' = Serial Transmit Section Alarm bus, TSAL input pin.
'0' = Microprocessor (internal register MP_TK2K1).
R/W
'0'
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PDF描述
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