參數(shù)資料
型號： MQ80C52EXXX-25:RD
廠商： TEMIC SEMICONDUCTORS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CQFP44
文件頁數(shù)： 45/586頁
文件大小： 25028K
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139
8272E–AVR–04/2013
ATmega164A/PA/324A/PA/644A/PA/1284/P
temporary High Byte Register (TEMP). This temporary register is shared by all the other 16-bit
16.12.11 ICR3H and ICR3L – Input Capture Register 3
The Input Capture is updated with the counter (TCNT3) value each time an event occurs on the
ICPn pin (or optionally on the Analog Comparator output for Timer/Counter3). The Input Capture
can be used for defining the counter TOP value.
The Input Capture Register is 16-bit in size. To ensure that both the high and low bytes are read
simultaneously when the CPU accesses these registers, the access is performed using an 8-bit
temporary High Byte Register (TEMP). This temporary register is shared by all the other 16-bit
16.12.12 TIMSK1 – Timer/Counter1 Interrupt Mask Register
Bit 7:6 – Reserved
These bits are unused and will always read as zero.
Bit 5 – ICIE1: Timer/Counter1, Input Capture Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Counter1 Input Capture interrupt is enabled. The corresponding Interrupt
Vector (see “Interrupts” on page 61) is executed when the ICF1 Flag, located in TIFR1, is set.
Bit 4:3 – Reserved
These bits are unused and will always read as zero.
Bit 2 – OCIE1B: Timer/Counter1, Output Compare B Match Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Counter1 Output Compare B Match interrupt is enabled. The corresponding
Interrupt Vector (see “Interrupts” on page 61) is executed when the OCF1B Flag, located in
TIFR1, is set.
Bit 1 – OCIE1A: Timer/Counter1, Output Compare A Match Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Counter1 Output Compare A Match interrupt is enabled. The corresponding
Interrupt Vector (see “Interrupts” on page 61) is executed when the OCF1A Flag, located in
TIFR1, is set.
Bit
76543210
(0x97)
ICR3[15:8]
ICR3H
(0x96)
ICR3[7:0]
ICR3L
Read/Write
R/W
Initial Value
00000000
Bit
7
65
43
2
1
0
–
–ICIE1
–
OCIE1B
OCIE1A
TOIE1
TIMSK1
Read/Write
R
R/W
R
R/W
Initial Value
0
相關(guān)PDF資料
PDF描述
MQ80C52EXXX-30/883 8-BIT, MROM, 30 MHz, MICROCONTROLLER, CQFP44
MQ80C52EXXX-36SHXXX:RD 8-BIT, MROM, 36 MHz, MICROCONTROLLER, CQFP44
MQ80C52TXXX-25/883:D 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CQFP44
MD80C32-20SHXXX 8-BIT, 20 MHz, MICROCONTROLLER, CDIP40
MC80C52CXXX-30SHXXX 8-BIT, MROM, 30 MHz, MICROCONTROLLER, CDIP40
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參數(shù)描述
MQ82370-20 制造商:Rochester Electronics LLC 功能描述:- Bulk
MQ8238020 制造商:Intel 功能描述:CONTROLLER: OTHER
MQ82380-20 制造商:Rochester Electronics LLC 功能描述:- Bulk
MQ82380-20/R 制造商:Rochester Electronics LLC 功能描述:
MQ82592 制造商:Rochester Electronics LLC 功能描述:- Bulk
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