- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄384065 > μPD45D128842 (NEC Corp.) 128 M-bit Synchronous DRAM with Double Data Rate(128 同步動(dòng)態(tài)RAM) PDF資料下載
參數(shù)資料
| 型號(hào)： | μPD45D128842 |
| 廠商： | NEC Corp. |
| 英文描述： | 128 M-bit Synchronous DRAM with Double Data Rate(128 同步動(dòng)態(tài)RAM) |
| 中文描述： | 128 M位同步雙數(shù)據(jù)速率（128同步動(dòng)態(tài)RAM的內(nèi)存） |
| 文件頁數(shù)： | 34/80頁 |
| 文件大?。?/td> | 637K |
| 代理商： | ΜPD45D128842 |
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34
μ
PD45D128442, 45D128842, 45D128164
Preliminary Data Sheet
12. Burst Termination
12.1 Burst Stop Command in Read Cycle
During a burst read cycle, when the burst stop command is issued at the rising edge of the clock (CLK), the burst
read data are terminated and the data bus goes to high impedance after the /CAS latency from the burst stop
command.
CLK
T0
T2
T1
T3
T4
T5
T6
T7
T8
Burst length = 8
T9
Q1
Q2
Q3
READ
DQ
Command
Q4
Q1
Q2
DQ
Command
Q3
Q4
/CAS latency = 2
/CAS latency = 2.5
/CLK
CKE
T10
T11
READ
(When t
RAS
is satisfied)
BST
BST
Hi-Z
Hi-Z
T0
T2
T1
T3
T4
T5
Remark
BST means Burst Stop command
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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