One of the dual-purpose external clock outputs becomes the fbin input pin in this mode." />
參數(shù)資料
型號： 5CGXFC7D7F31C8NES
廠商： Altera
文件頁數(shù)： 934/1077頁
文件大小： 0K
描述： IC CYCLONE V FPGA 150K 896-FBGA
標準包裝： 27
系列： Cyclone® V GX
LAB/CLB數(shù)： 56415
邏輯元件/單元數(shù)： 149500
RAM 位總計： 6656000
輸入/輸出數(shù)： 480
電源電壓： 1.07 V ~ 1.13 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 896-BGA
供應商設備封裝： 896-FBGA（31x31）
其它名稱： 544-2738
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One of the dual-purpose external clock outputs becomes the fbin input pin in this mode. The external
feedback input pin, fbin is phase-aligned with the clock input pin. Aligning these clocks allows you to
remove clock delay and skew between devices.
When using EFB mode, you must use the same I/O standard on the input clock, feedback input, and clock
outputs.
This mode is supported only on the corner fractional PLLs. For Cyclone V E A2 and A4 devices, and
Cyclone V GX C3 device, EFB mode is supported only on the left corner fractional PLLs.
Figure 4-31: EFB Mode in Cyclone V Devices
inclk
C0
C1
C2
C3
C4
C5
C6
C7
C8
M
fbout
fbin
fbin[n]
fbout[n]
fbout[p]
fbin[p]
2
10
I/O / FPLL_<#>_CLKOUT0
/ FPLL_<#>_CLKOUTp /
FPLL_<#>_FB
I/O / FPLL_<#>_CLKOUT1 /
FPLL_<#>_ CLKOUTn
I/O /FPLL_<#>_FBp
I/O / FPLL_<#>_FBn
÷
N
PFD
VCO 0
CP/LF
Multiplexer
External board connection for one
single-ended clock output and one
single-ended feedback input for
single-ended EFB support.
For single-ended EFB mode,
FPLL_<#>_CLKOUT1 is the fbout
output pin; while the FPLL_<#>_FB is
the fbin input pin.
External board connection for one
differential clock output and one
differential feedback input for
differential EFB support.
For differential EFB mode,
FPLL_<#>_CLKOUT[p,n] are the
fbout[p,n] output pin; while
FPLL_<#>_FB[p,n] are the fbin[p,n]
input pins.
External
Board Trace
EXTCLKOUT[0]
EXTCLKOUT[1]
Figure 4-32: Example of Phase Relationship Between the PLL Clocks in EFB Mode
Dedicated PLL
Clock Outputs
PLL Clock at
the Register
Clock Port
fbin Clock Input Pin
Phase Aligned
PLL Reference
Clock at the
Input Pin
The PLL clock outputs
can lead or lag the fbin
clock input.
Clock Networks and PLLs in Cyclone V Devices
Altera Corporation
CV-52004
External Feedback Mode
4-30
2014.01.10
相關PDF資料
PDF描述
668-0003-C IC CPU RABBIT2000 30MHZ 100PQFP
668-0011 IC MPU RABIT3000A 55.5MHZ128LQFP
6PAIC3106IRGZRQ1 IC AUDIO CODEC STEREO 48-QFN
70001851 DEVICE SERVER 1PORT SRL-ETHERNET
73M1822-IM/F MICRODAA VOICE DATA/FAX 42-QFN
相關代理商/技術參數(shù)
參數(shù)描述
5CGXFC9A6U19A7N 功能描述:IC FPGA 240 I/O 484UBGA 制造商:altera 系列:Cyclone? V GX 零件狀態(tài):有效 LAB/CLB 數(shù):113560 邏輯元件/單元數(shù):301000 總 RAM 位數(shù):14251008 I/O 數(shù):240 柵極數(shù):- 電壓 - 電源:1.07 V ~ 1.13 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 125°C （TJ） 封裝/外殼:484-FBGA 供應商器件封裝:484-UBGA（19x19） 標準包裝:84
5CGXFC9A6U19C7N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Cyclone V GX 113560 LABs 560 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
5CGXFC9A6U19I7 功能描述:IC FPGA 240 I/O 484UBGA 制造商:altera 系列:Cyclone? V GX 零件狀態(tài):有效 LAB/CLB 數(shù):113560 邏輯元件/單元數(shù):301000 總 RAM 位數(shù):14251008 I/O 數(shù):240 柵極數(shù):- 電壓 - 電源:1.07 V ~ 1.13 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C（TJ） 封裝/外殼:484-FBGA 供應商器件封裝:484-UBGA（19x19） 標準包裝:84
5CGXFC9A6U19I7N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Cyclone V GX 113560 LABs 560 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
5CGXFC9A7U19C8N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Cyclone V GX 113560 LABs 560 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
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