參數(shù)資料
型號： 74HCT75D
廠商： NXP SEMICONDUCTORS
元件分類： 鎖存器
英文描述： Quad bistable transparent latch
中文描述： HCT SERIES, DUAL HIGH LEVEL TRIGGERED D LATCH, COMPLEMENTARY OUTPUT, PDSO16
封裝： PLASTIC, SO-16
文件頁數(shù)： 7/7頁
文件大小： 57K
代理商： 74HCT75D
December 1990
7
Philips Semiconductors
Product specification
Quad bistable transparent latch
74HC/HCT75
AC WAVEFORMS
Fig.6
Waveforms showing the data input (nD) to
output (nQ) propagation delays and the
output transition times.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
Fig.7
Waveforms showing the data input (nD) to
output (nQ) propagation delays and the
output transition times.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
Fig.8
Waveforms showing the latch enable input
(LE
n-n
) pulse width, the latch enable input to
outputs (nQ, nQ) propagation delays and
the output transition times.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
PACKAGE OUTLINES
See
“74HC/HCT/HCU/HCMOS Logic Package Outlines”
.
Fig.9
Waveforms showing the data set-up and
hold times for nD input to LE
n-n
input.
The shaded areas indicate when the input is permitted to change
for predictable output performance.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
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