參數(shù)資料
型號： 74LVC374ADB,118
廠商： NXP Semiconductors
文件頁數(shù)： 17/19頁
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描述： IC OCT D FF POS-EDG TRIG 20SSOP
產(chǎn)品培訓模塊： Logic Packages
標準包裝： 1,000
系列： 74LVC
功能： 標準
類型： D 型總線
輸出類型： 三態(tài)非反相
元件數(shù)： 1
每個元件的位元數(shù)： 8
頻率 - 時鐘： 80MHz
延遲時間 - 傳輸： 1.5ns
觸發(fā)器類型： 正邊沿
輸出電流高，低： 24mA，24mA
電源電壓： 1.2 V ~ 3.6 V
工作溫度： -40°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 20-SSOP（0.209"，5.30mm 寬）
包裝： 帶卷 (TR)
74LVC374A
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NXP B.V. 2012. All rights reserved.
Product data sheet
Rev. 3 — 6 December 2012
7 of 19
NXP Semiconductors
74LVC374A
Octal D-type flip-flop; 5 V tolerant inputs/outputs; positive-edge trigger; 3-state
[1]
All typical values are measured at VCC = 3.3 V (unless stated otherwise) and Tamb =25 C.
10. Dynamic characteristics
II
input leakage
current
VCC = 3.6 V; VI =5.5 V orGND
-
0.1
5-
20
A
IOZ
OFF-state
output
current
VI =VIH or VIL; VCC = 3.6 V;
VO = 5.5 V or GND;
-
0.1
5-
20
A
IOFF
power-off
leakage
current
VCC = 0 V; VI or VO = 5.5 V
-
0.1
10
-
20
A
ICC
supply
current
VCC = 3.6 V; VI =VCC or GND;
IO =0A
-0.1
10
-
40
A
I
CC
additional
supply
current
per input pin; VCC = 2.7 V to 3.6 V;
VI =VCC 0.6 V; IO =0A
-5
500
-
5000
A
CI
input
capacitance
VCC = 0 V to 3.6 V;
VI =GND to VCC
-4.0
-
pF
Table 6.
Static characteristics …continued
At recommended operating conditions. Voltages are referenced to GND (ground = 0 V).
Symbol Parameter
Conditions
40 C to +85 C
40 C to +125 C
Unit
Min
Typ[1]
Max
Min
Max
Table 7.
Dynamic characteristics
Voltages are referenced to GND (ground = 0 V). For test circuit see Figure 10.
Symbol Parameter
Conditions
40 C to +85 C
40 C to +125 C Unit
Min
Typ[1]
Max
Min
Max
tpd
propagation
delay
CP to Qn; see Figure 7
VCC = 1.2 V
-
16
-
ns
VCC = 1.65 V to 1.95 V
2.2
7.4
16.3
2.2
18.8
ns
VCC = 2.3 V to 2.7 V
1.5
3.9
8.4
1.5
9.7
ns
VCC = 2.7 V
1.5
3.5
8.0
1.5
10.0
ns
VCC = 3.0 V to 3.6 V
1.5
3.3
7.0
1.5
9.0
ns
ten
enable time
OE to Qn; see Figure 8
VCC = 1.2 V
-
19
-
ns
VCC = 1.65 V to 1.95 V
1.5
6.6
16.7
1.5
19.3
ns
VCC = 2.3 V to 2.7 V
1.5
3.7
9.3
1.5
10.8
ns
VCC = 2.7 V
1.5
3.8
8.5
1.5
11.0
ns
VCC = 3.0 V to 3.6 V
1.5
3.0
7.5
1.5
9.5
ns
tdis
disable time
OE to Qn; see Figure 8
VCC = 1.2 V
-
8.0
-
ns
VCC = 1.65 V to 1.95 V
2.3
4.0
10.1
2.3
11.7
ns
VCC = 2.3 V to 2.7 V
1.0
2.2
5.7
1.0
6.7
ns
VCC = 2.7 V
1.5
3.1
6.5
1.5
9.0
ns
VCC = 3.0 V to 3.6 V
1.5
2.9
6.0
1.5
7.5
ns
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