參數(shù)資料
型號(hào)： 74LVXC4245WM
廠商： FAIRCHILD SEMICONDUCTOR CORP
元件分類： 通用總線功能
英文描述： 8-Bit Dual Supply Configurable Voltage Interface Transceiver with 3-STATE Outputs
中文描述： LV/LV-A/LVX/H SERIES, 8-BIT TRANSCEIVER, TRUE OUTPUT, PDSO24
封裝： 0.300 INCH, MS-013, SOIC-24
文件頁數(shù)： 6/11頁
文件大?。?/td> 178K
代理商： 74LVXC4245WM
74LVXC4245
6/11
AC ELECTRICAL CHARACTERISTICS
(C
L
= 50pF, Input t
r
= t
f
= 3ns)
1) Skew is defined as the absolute value of the difference between the actual propagation delay for any two outputs of the same device switch-
ing in the same direction, either HIGH or LOW (t
OSLH
= | t
PLHm
- t
PLHn
|, t
OSHL
= | t
PHLm
- t
PHLn
|
2) Parameter guaranteed by design
3) Typical values referred at V
CCA
= 5.0V, V
CCB
= 5.0V or V
CCA
= 5.0V, V
CCB
= 3.3V
(*) Voltage Range is 5.0V
±
0.5
Symbol
Parameter
Test Condition
Value
(3)
Unit
V
CCB
(V)
T
A
= 25°C
-40 to 85°C
-55 to 125°C
Min.
Typ.
Max.
Min.
Max.
Min.
Max.
t
PLH
Propagation Delay
Time (An to Bn)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
2.7 to
3.6
5.0
(*)
1.0
5.5
7.5
1.0
8.0
1.0
8.5
ns
1.0
4.9
6.5
1.0
7.0
1.0
7.5
t
PHL
Propagation Delay
Time (An to Bn)
1.0
5.0
7.0
1.0
7.5
1.0
7.5
1.0
4.0
5.5
1.0
6.0
1.0
6.5
t
PZL
Output Enable
Time (G to Bn)
1.0
6.7
9.0
1.0
10.0
1.0
10.5
ns
1.0
5.6
7.5
1.0
8.0
1.0
8.5
t
PZH
Output Enable
Time (G to Bn)
1.0
6.9
9.5
1.0
10.0
1.0
10.5
1.0
5.7
7.5
1.0
8.0
1.0
8.5
t
PLZ
Output Disable
Time (G to Bn)
1.0
6.0
9.0
1.0
9.5
1.0
9.5
ns
1.0
4.8
7.0
1.0
7.5
1.0
7.5
t
PHZ
Output Disable
Time (G to Bn)
1.0
4.2
6.5
1.0
7.0
1.0
7.5
1.0
3.8
5.5
1.0
6.0
1.0
6.5
t
PLH
Propagation Delay
Time (Bn to An)
1.0
5.6
7.5
1.0
8.0
1.0
8.5
ns
1.0
4.7
6.5
1.0
7.0
1.0
7.5
t
PHL
Propagation Delay
Time (Bn to An)
1.0
4.3
6.0
1.0
6.5
1.0
7.0
1.0
3.9
5.0
1.0
5.5
1.0
5.5
t
PZL
Output Enable
Time (G to An)
1.0
8.0
10.0
1.0
11.0
1.0
11.5
ns
1.0
7.4
9.0
1.0
10.0
1.0
10.5
t
PZH
Output Enable
Time (G to An)
1.0
6.3
8.0
1.0
8.5
1.0
8.5
1.0
6.1
7.5
1.0
8.5
1.0
8.5
t
PLZ
Output Disable
Time (G to An)
1.0
3.4
5.5
1.0
6.0
1.0
6.5
ns
1.0
3.4
5.5
1.0
6.0
1.0
6.5
t
PHZ
Output Disable
Time (G to An)
1.0
2.9
5.0
1.0
5.5
1.0
6.0
1.0
2.9
0.5
4.5
1.0
1.0
5.0
1.5
1.0
5.5
1.5
t
OSLH
t
OSHL
Output To Output
Skew Time (note1,
2)
ns
0.5
1.0
1.5
1.5
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PDF描述
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