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參數(shù)資料
| 型號： | 79RC32438-200BB |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 161/654頁 |
| 文件大?。?/td> | 6963K |
| 代理商： | 79RC32438-200BB |
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Notes
79RC32438 User Reference Manual
4 - 1
November 4, 2002
Chapter 4
System Integrity Functions
Introduction
This chapter describes the system integrity functions on the RC32438. The system integrity module
includes several registers that log system activity. These registers can be used to indicate the source of
hardware or software errors.
Features
Programmable bus transaction timer generates warm reset when counter expires
Address space monitor
Programmable watchdog timer generates NMI when counter expires
Functional Overview
The RC32438 supports three functions to monitor activity within the system and report potential hard-
ware or software error conditions.
The first function is the bus transaction timer. The bus transaction timer times memory and peripheral
bus transactions, generating a warm reset if a transaction does not complete within a specified number of
clock cycles. The bus transaction timer is part of the device controller. For more information on the bus
transaction timer, see the Memory and Peripheral Bus Transaction Timer section in Chapter 6.
A second function is the address space monitor. The address space monitor generates an error in
response to bus transactions with invalid RC32438 local address space addresses. This applies to transac-
tions generated by the CPU as well as the PCI and DMA controllers.
A third function is the watchdog timer. The watchdog timer is a general purpose timer that, if not periodi-
cally reset by software, generates a nonmaskable interrupt (NMI) exception to the CPU or a warm reset.
The watchdog timer is independent from the three general purpose timers described in Chapter 14, Counter
Timers.
System integrity functions are controlled, and their status is reported in the Error Control and Status
(ERRCS) Register. The bus transaction timer, the address space monitor, and the watchdog are all enabled
following a cold reset. The bus timer and watchdog timer can be individually disabled by software.
The address of an undecoded CPU read/write operation or IPBus slave acknowledge error is recorded
in the CPU Error Address (CEA) register. This register is only accessible by the CPU since it is located in
the CPU BIU.
System Integrity Register Description
Register Offset
1
Register Name
Register Function
Size
0x03_0000 through 0x03_002C
Reserved
0x03_0030
ERRCS
Error control and status
32-bit
0x03_0034
WTCOUNT
Watchdog timer count
32-bit
Table 4.1 System Integrity Register Map (Part 1 of 2)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 79RC32438-200BBI | Microprocessor |
| 79RC32438-233BB | Microprocessor |
| 79RC32438-233BBI | Microprocessor |
| 79RC32T335-133DH | MICROPROCESSOR|32-BIT|QFP|208PIN|PLASTIC |
| 79RC32T335-133DHI | MICROPROCESSOR|32-BIT|QFP|208PIN|PLASTIC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 79RC32438-200BBI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32438-233BB | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32438-233BBI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32H434-266BC | 功能描述:處理器 - 專門應(yīng)用 RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MAPBGA-432 |
| 79RC32H434-266BCG | 功能描述:處理器 - 專門應(yīng)用 RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MAPBGA-432 |
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