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參數(shù)資料
| 型號： | 92HD005XX3NLGXYYX |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 編解碼器 |
| 英文描述： | 4-CHANNEL HD AUDIO CODEC WITH QUAD DIGITAL MICROPHONE INTERFACE |
| 中文描述： | PCM CODEC, QCC48 |
| 封裝： | ROHS COMPLIANT, QFN-48 |
| 文件頁數(shù)： | 14/205頁 |
| 文件大小： | 1412K |
| 代理商： | 92HD005XX3NLGXYYX |
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92HD005/92HD005D
4-CHANNEL HD AUDIO CODEC WITH QUAD DIGITAL MICROPHONE INTERFACE
PC AUDIO
IDT
14
92HD005/92HD005D
V 1.0 12/06
4-CHANNEL HD AUDIO CODEC WITH QUAD DIGITAL MICROPHONE INTERFACE
Figure 2. System Diagram
1.3.
Detailed Description
1.3.1.
Low-voltage High Definition Audio Link Signaling
The 92HD005/92HD005D are compatible with either 1.5 V or 3.3 V High Definition Audio Link signal-
ing; the voltage selection is performed dynamically based on the input voltage of DVDD_IO. Note
that DVDD_IO is not a logic configuration pin but provides the digital power supply to be used for the
High Definition Audio Link signals.
When in 1.5 V mode, the 92HD005/92HD005D can correctly decode BITCLK, SYNC, RESET# and
SDO because they operate at 1.5 V. Additionally, it will drive SDI_CODEC at 1.5 V. None of the
GPIOs are affected, as they always function at their nominal voltage (DVDD or AVDD).
1.3.2.
Digital Microphone Support
The digital microphone interface permits connection of digital microphones to the
92HD005/92HD005D via the DMIC0, DMIC1, and DMIC_CLK three-pin interface. The DMIC0 and
DMIC1 pins carry either 1 or 2 channels of digital microphone data to the 92HD005/92HD005D. In
the event that a single microphone is used, the data is routed to both ADC channels.
The DMIC_CLK output is programmable from 1.176 MHz to 4.704 MHz in 1.176 MHz increments
and is synchronous to the 24 MHz internal clock. The default frequency is 2.352 MHz.
The 92HD005/92HD005D supports the digital microphone configurations listed in Table 1.
I/O Controller Hub (ICH)
92HD005
HD Audio Bus
Head Phone
Speakers
Sub Woofer
Line In
Microphone
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