參數(shù)資料
型號: 92HD81B1X3NLGXYYX8
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 編解碼器
英文描述: PCM CODEC, QCC48
封裝: ROHS COMPLIANT, QFN-48
文件頁數(shù): 272/294頁
文件大?。?/td> 3759K
代理商: 92HD81B1X3NLGXYYX8
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92HD81
V 0.97 01/09
SINGLE CHIP PC AUDIO SYSTEM, CODEC+SPEAKER AMPLIFIER+CAPLESS HP+LDO
92HD81
SINGLE CHIP PC AUDIO SYSTEM, CODEC+SPEAKER AMPLIFIER+CAPLESS HP+LDO
PC AUDIO
Field Name
Bits
R/W
Default
Reset
Rsvd
31:2
R
00000000h
N/A (Hard-coded)
Reserved.
D5
1
RW
0h
POR - ELR
Vendor specific D5 power state, only entered once the part is already in D3cold
(this bit must be set before the command to enter D3cold). If set, this bit over-
rides the D4 bit (bit 0). Includes the power savings of D4, but additionally pow-
ers down GPIO pins, the VAG amp, and the HP amps. Exits this power state
via POR or rising edge of Link Reset.
D4
0
RW
0h
POR - ELR
Vendor specific D4 power state, only entered once the part is already in D3cold
(this bit must be set before the command to enter D3cold). If the D5 bit (bit 1)
is set, this bit is overridden. Includes the power savings of D3cold, but addi-
tionally powers down the HDA interface (no responses). Exit this power state
via POR or rising edge of Link Reset.
7.4.26. AFG (NID = 01h): AnaPort
Reg
Byte 4 (Bits 31:24)
Byte 3 (Bits 23:16)
Byte 2 (Bits 15:8)
Byte 1 (Bits 7:0)
Set
7EDh
7ECh
Get
FEC00h
Field Name
Bits
R/W
Default
Reset
Rsvd2
31:7
R
0000000h
N/A (Hard-coded)
Reserved.
MonoPwd
6
RW
0h
POR - S&DAFG - ULR
Power down Mono Output.
FPwd
5
RW
0h
POR - S&DAFG - ULR
Power down Port F.
EPwd
4
RW
0h
POR - S&DAFG - ULR
Power down Port E.
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PDF描述
92HD81B1C3NLGXYYX PCM CODEC, QCC48
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92HD83C1C3NLGXYYX8 SPECIALTY MICROPROCESSOR CIRCUIT, QCC48
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參數(shù)描述
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