參數(shù)資料
型號： 935174990112
廠商： NXP SEMICONDUCTORS
元件分類： 計數(shù)器
英文描述： LV/LV-A/LVX/H SERIES, ASYN NEGATIVE EDGE TRIGGERED 14-BIT UP BINARY COUNTER, PDSO16
封裝： 4.40 MM, PLASTIC, MO-153, SOT-403-1, TSSOP1-16
文件頁數(shù)： 8/13頁
文件大小： 178K
代理商： 935174990112
Philips Semiconductors
Product specification
74LV4060
14-stage binary ripple counter with oscillator
1998 Jun 23
4
DYNAMIC POWER DISSIPATION
GND = 0 V; Tamb = 25 _C
PARAMETER
VCC
(V)
TYPICAL FORMULA FOR PD (mW)1
Total dynamic power dissipation when
using the on–chip oscillator (PD)
1.2
2.0
3.0
CPD x fosc x VCC2 + S (CL x VCC2 x fo) + 2Ct x VCC2 x fosc + 16 x VCC
CPD x fosc x VCC2 + S (CL x VCC2 x fo) + 2Ct x VCC2 x fosc + 460 x VCC
CPD x fosc x VCC2 + S (CL x VCC2 x fo) + 2Ct x VCC2 x fosc + 1000 x VCC
NOTE:
1. Where: fo = output frequency in MHz; fosc = oscillator frequency in MHz;
S (CL xVCC2 xfo) = sum of the outputs; CL = output load capacitance in pF;
Ct = timing capacitance in pF; VCC = supply voltage in V.
FUNCTIONAL DIAGRAM
9
10
11
12
CTC
RTC
RS
MR
CD
CP
1
Q11
2
Q12
3
Q13
4
Q5
5
Q4
6
Q6
7
Q3
14-stage binary counter
13
Q8
14
Q7
15
Q9
SV00312
LOGIC DIAGRAM
CTC
RTC
RS
MR
Q11
Q3
Q13
Q9
FF14
FF12
FF10
FF4
CP
FF1
Q
CD
SV00313
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PDF描述
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935166750112 SPECIALTY TELECOM CIRCUIT, PDSO20
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