參數(shù)資料
型號(hào)： A3P1000-FFG256FG256
元件分類： FPGA
英文描述： FPGA, 1000000 GATES, PBGA256
封裝： 1 MM PITCH, FBGA-256
文件頁(yè)數(shù)： 26/608頁(yè)
文件大?。?/td> 20486K
代理商： A3P1000-FFG256FG256
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ProASIC3 DC and Switching Characteristics
v1.1
2 - 101
Part Number and Revision Date
Part Number 51700097-002-1
Revised January 2008
List of Changes
The following table lists critical changes that were made in the current version of the chapter.
Previous Version
Changes in Current Version (v1.1)
Page
v1.0
(January 2008)
In Table 2-2 Recommended Operating Conditions, TJ was listed in the symbol
column and was incorrect. It was corrected and changed to TA.
Temperature1, Maximum Operating Junction Temperature was changed from
110°C to 100°C for both commercial and industrial grades.
In the "PLL Contribution—PPLL" section, the following was deleted:
FCLKIN is the input clock frequency.
was incorrect. It previously said TJ and it was corrected and changed to TA.
In Table 2-101 ProASIC3 CCC/PLL Specification, the SCLK parameter and note 1
are new.
Table 2-111 JTAG 1532 was populated with the parameter data, which was not
in the previous version of the document.
v2.2
(July 2007)
This document was previously in datasheet v2.2. As a result of moving to the
handbook format, Actel restarted the version numbers so the new version
number is v1.0.
N/A
v2.1
(May 2007)
The TJ parameter in Table 3-2 Recommended Operating Conditions was
changed to TA, ambient temperature, and table notes 4–6 were added.
3-2
v2.0
(April 2007)
Table
3-5 Package
Thermal
Resistivities
was
updated
with
A3P1000
information. The note below the table is also new.
3-5
The timing characteristics tables were updated.
N/A
The "PLL Macro" section was updated to add information on the VCO and PLL
outputs during power-up.
2-15
Advanced v0.7
(January 2007)
The "PLL Macro" section was updated to include power-up information.
2-15
Table 2-11 ProASIC3 CCC/PLL Specification was updated.
2-29
Figure 2-19 Peak-to-Peak Jitter Definition is new.
2-18
The "SRAM and FIFO" section was updated with operation and timing
requirement information.
2-21
The "RESET" section was updated with read and write information.
2-25
The "RESET" section was updated with read and write information.
2-25
The"Introduction" in the "Advanced I/Os" section was updated to include
information on input and output buffers being disabled.
2-28
PCI-X 3.3 V was added to Table 2-11 VCCI Voltages and Compatible Standards.
2-29
In the Table 2-15 Levels of Hot-Swap Support, the ProASIC3 compliance
descriptions were updated for levels 3 and 4.
2-34
相關(guān)PDF資料
PDF描述
A3P1000-FFG484FG484 FPGA, 1000000 GATES, PBGA484
A3P1000-FFGG144FG144 FPGA, 1000000 GATES, PBGA144
A3P1000-FFGG256FG256 FPGA, 1000000 GATES, PBGA256
A3P1000-FFGG484FG484 FPGA, 1000000 GATES, PBGA484
A3P1000-FG144FG144 FPGA, 1000000 GATES, PBGA144
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
A3P1000-FFG484 制造商:Microsemi Corporation 功能描述:FPGA PROASIC3 1M GATES 193MHZ COMM 130NM 1.5V 484FBGA - Trays
A3P1000-FFGG144 制造商:Microsemi Corporation 功能描述:FPGA PROASIC3 1M GATES 193MHZ COMM 130NM 1.5V 144FBGA - Trays
A3P1000-FFGG144ES 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs
A3P1000-FFGG144I 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs
A3P1000-FFGG144PP 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs
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