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參數(shù)資料
| 型號： | A3PN250-1VQG100 |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 12/114頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA NANO 250K GATES 100-VQFP |
| 標(biāo)準包裝： | 90 |
| 系列： | ProASIC3 nano |
| RAM 位總計： | 36864 |
| 輸入/輸出數(shù)： | 68 |
| 門數(shù)： | 250000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 100-TQFP |
| 供應(yīng)商設(shè)備封裝： | 100-VQFP（14x14） |
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ProASIC3 nano Flash FPGAs
Revision 11
5-3
Revision 8
(continued)
The following tables were updated with available information:
through
Table 2-22 I/O Weak Pull-Up/Pull-Down Resistances was revised to add wide range
data and correct the formulas in the table notes (SAR 21348).
The text introducing Table 2-24 Duration of Short Circuit Event before Failure was
revised to state six months at 100° instead of three months at 110° for reliability
concerns. The row for 110° was removed from the table.
give values with Schmitt trigger disabled and enabled (SAR 24634). The temperature
for reliability was changed to 100C.
Wide Range and the timing tables in the "Single-Ended I/O Characteristics" section
were updated with available information. The timing tables for 3.3 V LVCMOS wide
range are new.
The following sentence was deleted from the "2.5 V LVCMOS" section: "It uses a 5 V–
tolerant input buffer and push-pull output buffer."
Propagation Delays (SAR 23919).
Resource were updated with available information.
through
Table 2-73 ProASIC3 nano CCC/PLL Specification was revised (SAR 79390).
Revision
Changes
Page
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PDF描述 |
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參數(shù)描述 |
|---|---|
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| A3PN250-2QNG100 | 制造商:Microsemi Corporation 功能描述:FPGA PROASIC3 NANO 250K GATES COMM 130NM 1.5V 100QFN - Trays 制造商:Microsemi SOC Products Group 功能描述:FPGA PROASIC3 NANO 250K GATES COMM 130NM 1.5V 100QFN - Trays |
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