2-50 Revision 11 Figure 2-20 Timing Model and Waveforms t
參數(shù)資料
型號： A3PN250-ZVQ100
廠商： Microsemi SoC
文件頁數(shù)： 76/114頁
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描述： IC FPGA NANO 250K GATES 100-VQFP
標(biāo)準(zhǔn)包裝： 90
系列： ProASIC3 nano
RAM 位總計(jì)： 36864
輸入/輸出數(shù)： 68
門數(shù)： 250000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 100-TQFP
供應(yīng)商設(shè)備封裝： 100-VQFP（14x14）
ProASIC3 nano DC and Switching Characteristics
2-50
Revision 11
Figure 2-20 Timing Model and Waveforms
tPD
A
B
tPD = MAX(tPD(RR), tPD(RF), tPD(FF), tPD(FR))
where edges are applicable for the particular
combinatorial cell
Y
NAND2 or
Any Combinatorial
Logic
tPD
50%
VCC
50%
GND
A, B, C
50%
(RR)
(RF)
GND
OUT
GND
50%
(FF)
(FR)
tPD
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PDF描述
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