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參數資料
| 型號： | A42MX16-1PL100ES |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 40MX and 42MX FPGA Families |
| 中文描述： | 40MX和42MX FPGA系列 |
| 文件頁數： | 117/120頁 |
| 文件大?。?/td> | 854K |
| 代理商： | A42MX16-1PL100ES |
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96
4958B–AUTO–11/10
Atmel ATA6285/ATA6286 [Preliminary]
3.13.6.3
Mode 3: Toggle Mode with Modulator Output T2O2 at the PD6 Pin
The Timer/Counter2 can be supplied with internal/external clocks. Mode 3 does use only one
modulator I/O pin (M2 --> T2O2) to work as waveform generator. The port pins (PD5, PD7) can
be used as general digital I/O. The Figure 3-39 shows an example of the Toggle mode.
Figure 3-39. Toggle Mode and Modulator Output at the T2O2 Pin, Timing Diagram
3.13.6.4
Mode 4: PWM Mode with Modulator Output T2O1 at the PD5 Pin
The Timer2/Counter2 can be supplied with internal/external clocks. Mode 4 uses only one mod-
ulator I/O pin (M2 --> T2O1) to work as pulse width modulator. The port pins (PD6, PD7) can be
used as general digital I/O. The timer has four different programmable fixed TOP values, which
can be selected with the T2TP[1..0] bits in the T2MRA register. The Figure 3-40 shows an exam-
ple of a PWM signal generation.
Figure 3-40. PWM Mode and Modulator Output at the T2O1 Pin, Timing Diagram
T2E
T2CNT
CLK
T2
T2COM
T2O2
T2COR
CL2
01
2
012
2
00
12
0
1
Compare value
update by compare
match interrupt
T2E
T2O1
0x03FF
T2CNT
TOP
相關PDF資料 |
PDF描述 |
|---|---|
| A42MX16-1PL100I | 40MX and 42MX FPGA Families |
| A42MX16-1PL100M | IC TVS BI-DIR 24V 350W SOD-323 |
| A42MX02-1BG100 | 40MX and 42MX FPGA Families |
| A42MX04-1BG100 | 40MX and 42MX FPGA Families |
| A42MX09-1BG100 | 40MX and 42MX FPGA Families |
相關代理商/技術參數 |
參數描述 |
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