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參數(shù)資料
| 型號： | A42MX16-1VQ100 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Power Transformer; Series:VPS; Power Rating:43VA; Mounting Type:Chassis; Current Rating:1.2 Series/2.4 Prllel A; External Depth:2.000"; External Height:2.688"; External Width:3.125"; Leaded Process Compatible:No |
| 中文描述： | 40MX和42MX FPGA系列 |
| 文件頁數(shù)： | 72/120頁 |
| 文件大?。?/td> | 854K |
| 代理商： | A42MX16-1VQ100 |
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4958B–AUTO–11/10
Atmel ATA6285/ATA6286 [Preliminary]
3.12.2
Ports as General Digital I/O
The ports are bi-directional I/O ports with optional internal pull-ups. Figure 3-22 shows a func-
tional description of one I/O-port pin, here generically called Pxn.
Figure 3-22. General Digital I/O(1)
WRx, WPx, WDx, RRx, RPx, and RDx are common to all pins within the same port. CLK
I/O,
SLEEP, and PUD are common to all ports.
3.12.2.1
Configuring the Pin
Each port pin consists of three register bits: DDxn, PORTxn, and PINxn. As shown in Section
3.12.4 “Register Description for I/O Ports” on page 67, the DDxn bits are accessed at the DDRx
I/O address, the PORTxn bits at the PORTx I/O address, and the PINxn bits at the PINx I/O
address.
The DDxn bit in the DDRx Register selects the direction of this pin. If DDxn is written logic one,
Pxn is configured as an output pin. If DDxn is written logic zero, Pxn is configured as an input
pin.
D
0
1
Q
WRx
RRx
WPx
Pnx
CLR
RESET
Synchronizer
D
ATA
B
U
S
PORTxn
Q
L
D
Q
D
Q
PINxn
RESET
RPx
PULLUP DISABLE
WDx:
WRITE DDRx
PUD:
I/O CLOCK
WRx:
WRITE PORTx
WPx:
WRITE PINx
RPx:
READ PINx
RRx:
READ PORTx
SLEEP CONTROL
RDx:
READ DDRx
SLEEP:
RDx
CLK
I/O
CLK:
I/O
SLEEP
PUD
WDx
D
Q
CLR
DDxn
Q
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A42MX24-1VQ100 | Power Transformer; Series:VPS; Supply Voltage:115V; Output Voltage:222V; Power Rating:80VA; Mounting Type:Chassis; External Depth:2.313"; External Height:3.000"; External Width:2.500"; Leaded Process Compatible:Yes |
| A42MX36-1VQ100 | XFRMR PWR 36.0VCT 3.6A QC .250 |
| A42MX02-1VQ100A | XFRMR PWR 36.0VCT 4.8A QC .250 |
| A42MX04-1VQ100A | XFRMR PWR 36.0VCT 0.7A QC .187 |
| A42MX09-1VQ100A | 40MX and 42MX FPGA Families |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| A42MX16-1VQ100A | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
| A42MX16-1VQ100B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
| A42MX16-1VQ100ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
| A42MX16-1VQ100I | 功能描述:IC FPGA MX SGL CHIP 24K 100-VQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:MX 標準包裝:40 系列:SX-A LAB/CLB數(shù):6036 邏輯元件/單元數(shù):- RAM 位總計:- 輸入/輸出數(shù):360 門數(shù):108000 電源電壓:2.25 V ~ 5.25 V 安裝類型:表面貼裝 工作溫度:0°C ~ 70°C 封裝/外殼:484-BGA 供應(yīng)商設(shè)備封裝:484-FPBGA（27X27） |
| A42MX16-1VQ100M | 制造商:Microsemi Corporation 功能描述:FPGA 24K GATES 608 CELLS 119MHZ/198MHZ 0.45UM 3.3V/5V 100VQF - Trays 制造商:Microsemi Corporation 功能描述:IC FPGA 83 I/O 100VQFP 制造商:Microsemi Corporation 功能描述:IC FPGA MX SGL CHIP 24K 100-VQFP |
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