參數(shù)資料
型號： A42MX24-3BG100ES
廠商： Electronic Theatre Controls, Inc.
英文描述： 40MX and 42MX FPGA Families
中文描述： 40MX和42MX FPGA系列
文件頁數(shù)： 41/123頁
文件大?。?/td> 854K
代理商： A42MX24-3BG100ES
40MX and 42MX FPGA Families
v6.0
1-35
PCI System Timing Specification
Table 26
and
Table 27
list the critical PCI timing
parameters and the corresponding timing parameters
for the MX PCI-compliant devices.
PCI Models
Actel provides synthesizable VHDL and Verilog-HDL
models for a PCI Target interface, a PCI Target and
Target+DMA Master interface. Contact your Actel sales
representative for more details.
Table 26
Clock Specification for 33 MHz PCI
Symbol
Parameter
PCI
A42MX24
A42MX36
Units
Min.
Max.
Min.
Max.
Min.
Max.
t
CYC
CLK Cycle Time
30
–
4.0
–
4.0
–
ns
t
HIGH
CLK High Time
11
–
1.9
–
1.9
–
ns
t
LOW
CLK Low Time
11
–
1.9
–
1.9
–
ns
Table 27
Timing Parameters for 33 MHz PCI
PCI
A42MX24
A42MX36
Symbol
Parameter
Min.
Max.
Min.
Max.
Min.
Max.
Units
t
VAL
CLK to Signal Valid—Bused Signals
2
11
2.0
9.0
2.0
9.0
ns
t
VAL(PTP)
CLK to Signal Valid—Point-to-Point
2
2
12
2.0
9.0
2.0
9.0
ns
t
ON
Float to Active
2
–
2.0
4.0
2.0
4.0
ns
t
OFF
Active to Float
–
28
–
8.3
1
–
8.3
1
ns
t
SU
Input Set-Up Time to CLK—Bused Signals
7
–
1.5
–
1.5
–
ns
t
SU(PTP)
Input Set-Up Time to CLK—Point-to-Point
10, 12
2
–
1.5
–
1.5
–
ns
t
H
Input Hold to CLK
0
–
0
–
0
–
ns
Notes:
1. T
OFF
is system dependent. MX PCI devices have 7.4 ns turn-off time, reflection is typically an additional 10 ns.
2. REQ# and GNT# are point-to-point signals and have different output valid delay and input setup times than do bussed signals.
GNT# has a setup of 10; REW# has a setup of 12.
相關(guān)PDF資料
PDF描述
A42MX24-3BG100I 40MX and 42MX FPGA Families
A42MX24-3BG100M 40MX and 42MX FPGA Families
A42MX24-3CQ100 40MX and 42MX FPGA Families
A42MX24-3CQ100A Octal Bus Transceivers With 3-State Outputs 20-SOIC -40 to 85
A42MX24-3CQ100B Octal Bus Transceivers With 3-State Outputs 20-SOIC -40 to 85
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A42MX24-3PL84I 功能描述:IC FPGA MX SGL CHIP 36K 84-PLCC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:MX 產(chǎn)品培訓(xùn)模塊:Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview 特色產(chǎn)品:Cyclone? IV FPGAs 標(biāo)準(zhǔn)包裝:60 系列:CYCLONE® IV GX LAB/CLB數(shù):9360 邏輯元件/單元數(shù):149760 RAM 位總計:6635520 輸入/輸出數(shù):270 門數(shù):- 電源電壓:1.16 V ~ 1.24 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:484-BGA 供應(yīng)商設(shè)備封裝:484-FBGA（23x23）
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