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參數(shù)資料
| 型號： | AA10C_07 |
| 英文描述： | SOCKET,SIPP,20PIN,MACHINE(L2) TOOLED PINS,WW,.435"LDS |
| 中文描述： | 36伏到75伏直流電輸入，10瓦 |
| 文件頁數(shù)： | 8/12頁 |
| 文件大?。?/td> | 97K |
| 代理商： | AA10C_07 |
Technical Reference Notes (TRN)
AA10C Series
36 Vdc to 75 Vdc Inputs, 10 W
_____________________________________________________________
ASTEC POWER - Andover
8 of 12
Note: Use a 2 x 0.47 uF ceramic capacitors. Scope measurement should be made using a BNC socket.
Position the load between 51 mm and 76 mm (2 in. and 3 in.) from module.
Figure 13. Peak-to-Peak Output Noise Measurement Test Setup.
Feature Descriptions
Output Overvoltage Clamp
The output overvoltage clamp consists of a separate control loop, independent of the primary
control loop. This control loop has a higher voltage setpoint than the primary loop. In a fault
condition the converter goes into “Hiccup Mode”, and the output overvoltage clamp ensures that
the output voltage does not exceed Vo,clamp,max. This secondary control loop provides a
redundant voltage-control that reduces the risk of output overvoltage.
Output Current Protection
To provide protection in an output overload or short circuit condition, the converter is equipped
with current limiting circuitry and can endure the fault condition for an unlimited duration. At the
point of current-limit inception, the converter goes into “Hiccup Mode”, causing the output current
to be limited both in peak and duration.The converter operates normally once the output current is
brought back into its specified range.
Enable (Optional)
Two enable option are available. Positive Logic Enable, suffix “4”, and Negative Logic Enable,
suffix “1”. Positive Logic Enable turns the converter on during a logic-high voltage on the enable
pin, and off during a logic-low. Negative Logic Enable turns the converter of during a logic-high
and on during a logic-low.
Output Voltage Adjustment (Optional)
Output voltage adjustment is accomplished by connecting an external resistor between the Vadj
Pin and either the +Vout or –Vout Pins.
With an external resistor between the Vadj Pin and +Vout Pin (R
adj-down
) the output voltage set
point (Vo,adj) decreases (see Figure 14). The following equation determines the required external
resistor value to obtain an adjusted output voltage:
Vo(+)
Vo(-)
RESISTIVE
LOAD
0.47 uF
0.47uF
SCOPE
COPPER STRIP
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PDF描述 |
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