參數資料
型號: AD1938WBSTZ
廠商: Analog Devices Inc
文件頁數: 14/32頁
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描述: IC CODEC 24BIT 4ADC/8DAC 48LQFP
標準包裝: 1
類型: 通用
數據接口: 串行
分辨率(位): 24 b
ADC / DAC 數量: 4 / 8
三角積分調變:
S/N 比,標準 ADC / DAC (db): 94 / 94
動態(tài)范圍,標準 ADC / DAC (db): 105 / 106
電壓 - 電源,模擬: 3 V ~ 3.6 V
電壓 - 電源,數字: 3 V ~ 3.6 V
工作溫度: -40°C ~ 125°C
安裝類型: 表面貼裝
封裝/外殼: 48-LQFP
供應商設備封裝: 48-LQFP(7x7)
包裝: 托盤
Data Sheet
AD1938
Rev. E | Page 21 of 32
05
58
2-
0
22
ALRCLK
ABCLK
4 ADC CHANNELS OF
SECOND IC IN THE CHAIN
4 ADC CHANNELS OF
FIRST IC IN THE CHAIN
ADC L1 ADC R1 ADC L2 ADC R2 ADC L1 ADC R1 ADC L2 ADC R2
ASDATA1 (TDM_OUT
OF THE SECOND AD193x
IN THE CHAIN)
ADC L1 ADC R1 ADC L2 ADC R2
ASDATA2 (TDM_IN
OF THE SECOND AD193x
IN THE CHAIN)
32 BITS
MSB
DSP
SECOND
AD193x
FIRST
AD193x
Figure 22. ADC TDM Daisy-Chain Mode (512 fS BCLK, Two-AD193x Daisy Chain)
05
582
-0
23
LRCLK
BCLK
SDATA
LRCLK
BCLK
SDATA
LRCLK
BCLK
SDATA
LSB
LEFT CHANNEL
RIGHT CHANNEL
LEFT CHANNEL
RIGHT CHANNEL
MSB
RIGHT-JUSTIFIED MODE—SELECT NUMBER OF BITS PER CHANNEL
DSP MODE—16 BITS TO 24 BITS PER CHANNEL
I2S-JUSTIFIED MODE—16 BITS TO 24 BITS PER CHANNEL
LEFT-JUSTIFIED MODE—16 BITS TO 24 BITS PER CHANNEL
LRCLK
BCLK
SDATA
LSB
NOTES
1. DSP MODE DOES NOT IDENTIFY CHANNEL.
2. LRCLK NORMALLY OPERATES AT
fS EXCEPT FOR DSP MODE WHICH IS 2 × fS.
3. BCLK FREQUENCY IS NORMALLY 64 × LRCLK BUT MAY BE OPERATED IN BURST MODE.
MSB
1/
fS
Figure 23. Stereo Serial Modes
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PDF描述
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參數描述
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AD1938XSTZ 制造商:Analog Devices 功能描述:AUD CODEC 4ADC / 8DAC 24BIT 48LQFP - Trays
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