參數(shù)資料
型號(hào): AD5206BRU50
廠商: ANALOG DEVICES INC
元件分類(lèi): 數(shù)字電位計(jì)
英文描述: Operator Interface; Display Technology:LED
中文描述: HEX 50K DIGITAL POTENTIOMETER, 3-WIRE SERIAL CONTROL INTERFACE, 256 POSITIONS, PDSO24
封裝: MS-013AD, SOIC-24
文件頁(yè)數(shù): 10/11頁(yè)
文件大小: 173K
代理商: AD5206BRU50
AD5204/AD5206
–10–
REV. 0
RDAC 1
RDAC 2
RDAC 4/6
AD5204/AD5206
SDI
CLK
CS
ADDR
DECODE
SERIAL
REGISTER
Figure 18. Equivalent Input Control Logic
The target RDAC latch is loaded with the last eight bits of the
serial data word completing one DAC update. Four separate 8-
bit data words must be clocked in to change all four VR settings.
SERIAL
REGISTER
SDI
CK
RS
D
Q
SHDN
CS
CLK
PR
SDO
GND
Figure 19. Detail SDO Output Schematic of the AD5204
All digital pins are protected with a series input resistor and
parallel Zener ESD structure shown in Figure 20. Applies to
digital pins
CS
, SDI, SDO,
PR
,
SHDN
, CLK
340k
V
LOGIC
V
SS
Figure 20. ESD Protection of Digital Pins
A, B, W
V
SS
Figure 21. ESD Protection of Resistor Terminals
V+
DUT
A
V
MS
B
W
V+ = V
1LSB = V+/256
Figure 22. Potentiometer Divider Nonlinearity Error Test
Circuit (INL, DNL)
NO CONNECT
I
W
DUT
A
V
MS
B
W
Figure 23. Resistor Position Nonlinearity Error (Rheostat
Operation; R-INL, R-DNL)
I
MS
V
W
I
W
=
1V/R
NOMINAL
DUT
A
V
MS
B
W
V+
W
R
W
= V
W2
–[V
W1
+ I
W
(R
AW
II R
BW
)]
WHERE V
= V
WHEN I
= 0
AND V
W2
= V
MS
WHEN I
W
= 1/R
V+
<
V
DD
Figure 24.Wiper Resistance Test Circuit
PSRR (dB) = 20 LOG
(
–V
)
PSS (%/%) = –V
V
DD
MS
%
V
DD
%
V+ = V
DD
± 10%
V
DD
V
A
~
V+
V
MS
A
B
W
Figure 25. Power Supply Sensitivity Test Circuit (PSS,
PSRR)
A
B
V
IN
OP279
+
+5V
V
OUT
DUT
W
OFFSET
GND
OFFSET BIAS
Figure 26. Inverting Programmable Gain Test Circuit
A
B
V
IN
OP279
+5V
V
OUT
DUT
W
OFFSET
GND
OFFSET BIAS
Figure 27. Noninverting Programmable Gain Test Circuit
+15V
–15V
A
B
V
IN
2.5V
OP42
V
OUT
DUT
W
OFFSET
GND
+
Figure 28. Gain vs. Frequency Test Circuit
I
SW
V
SS
TO V
DD
R
SW
=
0.1V
I
SW
CODE =
H
0.1V
DUT
B
W
+
Figure 29. Incremental ON Resistance Test Circuit
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