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參數(shù)資料
| 型號： | AD5232 |
| 廠商： | Analog Devices, Inc. |
| 元件分類： | 數(shù)字電位計 |
| 英文描述： | 8-Bit Dual Nonvolatile Memory Digital Potentiometer |
| 中文描述： | 8位雙非易失性內(nèi)存數(shù)字電位器 |
| 文件頁數(shù)： | 6/20頁 |
| 文件大?。?/td> | 268K |
| 代理商： | AD5232 |
REV. 0
–6–
AD5232
PIN FUNCT ION DE SCRIPT IONS
Pin
Number
1
2
3
Mnemonic
CLK
SDI
SDO
Description
Serial Input Register Clock Pin. Shifts in one bit at a time on positive clock edges.
Serial Data Input Pin. MSB Loaded First.
Serial Data Output Pin. Open Drain Output requires external pull-up resistor. Commands 9 and 10
activate the SDO output. See T able II. Other commands shift out the previously loaded SDI bit
pattern delayed by 16 clock pulses. T his allows daisy-chain operation of multiple packages.
Ground Pin, Logic Ground Reference.
Negative Supply. Connect to zero volts for single supply applications.
A T erminal of RDAC1
Wiper T erminal of RDAC1, ADDR(RDAC1) = 0
H
B T erminal of RDAC1
B T erminal of RDAC2
Wiper T erminal of RDAC2, ADDR(RDAC2) = 1
H
A T erminal of RDAC2
Positive Power Supply Pin
Write Protect Pin. When active low,
WP
prevents any changes to the present register contents, except
PR
and CMD 1 and 8 will refresh RDAC register from EEMEM. Execute a NOP instruction before
returning
WP
to logic high.
Hardware Override Preset Pin. Refreshes the scratch pad register with current contents of the EEMEM
register. Factory default loads midscale 80
H
until EEMEM is loaded with a new value by the user
(
PR
is activated at the logic high transition).
Serial Register Chip Select Active Low. Serial register operation takes place when
CS
returns to logic high.
Ready. Active-high open drain output, requires pull-up resistor. Identifies completion of commands
2, 3, 8, 9, 10, and
PR
.
4
5
6
7
8
9
10
11
12
13
GND
V
SS
A1
W1
B1
B2
W2
A2
V
DD
WP
14
PR
15
16
CS
RDY
TOP VIEW
(Not to Scale)
16
15
14
13
12
11
10
9
1
2
3
4
5
6
7
8
CLK
SDI
SDO
GND
V
SS
A1
W1
B1
RDY
CS
PR
WP
V
DD
A2
W2
B2
AD5232
PIN CONFIGURAT ION
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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