RFB 3
參數(shù)資料
型號(hào)： AD5543BR
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 17/20頁(yè)
文件大?。?/td> 0K
描述： IC DAC 16BIT SRLIN/CUR OUT 8SOIC
產(chǎn)品培訓(xùn)模塊： Data Converter Fundamentals
DAC Architectures
設(shè)計(jì)資源： Versatile High Precision Programmable Current Sources Using DACs, Op Amps, and MOSFET Transistors (CN0151)
標(biāo)準(zhǔn)包裝： 1
設(shè)置時(shí)間： 500ns
位數(shù)： 16
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 1
電壓電源： 單電源
功率耗散（最大）： 55µW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 8-SOIC（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 8-SO
包裝： 管件
輸出數(shù)目和類型： 1 電流，單極；1 電流，雙極
AD5543/AD5553
Data Sheet
Rev. F | Page 6 of 20
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
CLK
1
SDI
2
RFB 3
VREF 4
CS
8
VDD
7
GND
6
IOUT
5
AD5543/
AD5553
TOP VIEW
(Not to Scale)
02917-
004
Figure 6. Pin Configuration
Table 3. Pin Function Descriptions
Pin No.
Mnemonic
Description
1
CLK
Clock Input. Positive-edge triggered, clocks data into shift register.
2
SDI
Serial Register Input. Data loads directly into the shift register MSB first. Extra leading bits are ignored.
3
RFB
Internal Matching Feedback Resistor. This pin connects to an external op amp for voltage output.
4
VREF
DAC Reference Input Pin. Establishes DAC full-scale voltage. Constant input resistance vs. code.
5
IOUT
DAC Current Output. This pin connects to the inverting terminal of the external precision I-to-V op amp for
voltage output.
6
GND
Analog and Digital Ground.
7
VDD
Positive Power Supply Input. Specified range of operation at 5 V ± 10%.
8
CS
Chip Select. Active low digital input. Transfers shift-register data to DAC register on rising edge.
See Table 4 for operation.
Table 4. Control-Logic Truth Table
CLK
CS
Serial Shift Register Function
DAC Register
X
H
No effect
Latched
↑+1
L
Shift register data advanced one bit
Latched
H
No effect
Latched
↑+1
Shift register data transferred to DAC register
New data loaded from serial register
1
↑+ = positive logic transition; X = don't care.
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PDF描述
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